资源列表
TheDesignofFIRFilterBasedonFPGA
- 从分析FIR 数字滤波器的原理和设计方法入手,主要针对基于FPGA 实现数字滤波器乘法器的算法进行了比较研究,并通过一个8 阶FIR 低通滤波器的具体设计,简要分析比较了几种算法的优越性和缺点,从而充分发掘和利用FPGA 的高速特性。-From the analysis of FIR digital filter design theory and approach, mainly based on the realization of digital filter FPGA multiplie
quartus
- quartus中常见错误的解析以及解决办法，主要是VHDL也verilog HDL-Common Errors in quartus and the analytic solutions is mainly VHDL also verilog HDL
fifo
- first in first out VHDL code
VHDL
- VHDL hardware descr iption language
VHDLmultiplier
- 利用VHDL设计乘法器4乘4 利用VHDL设计乘法器4乘4-VHDL design using 4 × 4 multiplier
VHDLcodingStyle
- VHDL设计编码规范 VHDL设计编码规范-VHDL Design Coding Design Coding VHDL specification norms
XYJ
- 洗衣机控制程序，只需在QUARTUS中编译即可使用-washing machine controler
CPU
- 利用vhdl模拟实现CPU的功能，实现其中的加减乘除等多种运算-CPU utilization of vhdl simulation of the realization of the function, the realization of which, such as addition and subtraction, multiplication and division multiple computing
FPGAbasedschematicdiagramofthephasemeasurement
- 基于FPGA的相位测量原理图,完全用原理图的方式对相位差进行测量-FPGA-based schematic diagram of the phase measurement, complete with schematic diagram of the measurement on the phase difference
stack.vhd
- stack for the protocol used to implement into FPGA
quartus2_user_guide
- QuartusII最完整版使用指南，适合每位开发者-The most complete version of QuartusII guide for every developer
sdfdf
- 设计并制作一台数字显示的简易频率计。 （二）要求 1.基本要求 (1)频率测量 a.测量范围 信号：方波、正弦波 幅度：0.5V～5V[注] 频率：1Hz～1MHz b.测试误差≤0.1 (2)周期测量 a.测量范围 信号：方波、正弦波 幅度：0.5V～5V[注] 频率：1Hz～1MHz b.测试误差≤0.1 键盘从上到下，从左到有依次为： 1 2 3 4 5 6 7 8 9 0 .