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  2. 风力发电逆变器设计,很好,值得学习一下-2MW wind power inverter design, very good
  3. 所属分类:SCM

    • 发布日期:2017-04-25
    • 文件大小:255.71kb
    • 提供者:szsyyr
  1. add

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  2. 加法器的实现,用VHDL/FPGA/Verilog制作的实现的- adding machine use VHDL/FPGA/Verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:255.71kb
    • 提供者:大梦
  1. Monitor

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  2. 中国移动基站拨测系统 设备端监控主程序,主要是嵌入式设备端的监控主程序-China Mobile' s base station equipment-side monitoring measurement system call the main program, mainly embedded devices to monitor the main program end
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-07
    • 文件大小:255.71kb
    • 提供者:李延新
  1. 5-2812PID

    0下载:
  2. 数字信号处理器F2812程序,PID代码,编程时参考。-F2812 digital signal processor program, PID code, the programming reference.
  3. 所属分类:DSP program

    • 发布日期:2017-04-27
    • 文件大小:255.72kb
    • 提供者:feiyang
  1. s3c2410_ADC

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  2. 我写的一个2410的ADC程序,精确度还错,可以在串口中显示,用键盘控制
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2014-01-16
    • 文件大小:255.73kb
    • 提供者:xiaogao
  1. SobelEdge

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  2. 通过对该工程的代码学习,理解和掌握图像的边缘检测的原理和方法。-Understand and grasp the image edge detection principle and method.
  3. 所属分类:DSP program

    • 发布日期:2017-04-02
    • 文件大小:255.73kb
    • 提供者:wanyukun
  1. 1602

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  2. DSP2812驱动LCD1602例程,。-DSP2812 drive LCD1602 routine.
  3. 所属分类:DSP program

    • 发布日期:2017-04-29
    • 文件大小:255.74kb
    • 提供者:董振
  1. 89c52

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  2. 本系统采用单片机AT89S52为控制核心,实现电子秤的基本控制功能。系统的硬件部分包括最小系统板,数据采集、人机交互界面三大部分。最小系统部分主要是扩展了外部数据存储器,数据采集部分由压力传感器、信号的前级处理和A/D转换部分组成。人机界面部分为键盘输入 ,128 64点阵式液晶显示,可以直观的显示中文,使用方便。-The system uses a single chip AT89S52 as the control center for electronic scale basic cont
  3. 所属分类:SCM

    • 发布日期:2017-04-16
    • 文件大小:255.74kb
    • 提供者:许多趣
  1. sicendianti

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  2. VHDL实现四层电梯的控制。状态机、编解码器、触发器、比较器。-Four layers of elevator control is realized by VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:255.74kb
    • 提供者:徐高兵
  1. pulse10

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  2. VHDL十分频程序源代码。简单修改代码中的值就可以得到其他分频。-VHDL is very frequency of program source code. Simple to modify the code in the value you can get other divider.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-07
    • 文件大小:255.75kb
    • 提供者:天涯
  1. Counter

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  2. VHDL硬件描述,使用环境为Quartus2 6.1 分别为16进制及60进制计数器的源代码
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:255.75kb
    • 提供者:李若珍
  1. add32

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  2. 32位加法器,verilog实现,且有仿真图像-32-bit adder and programed by veilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:255.76kb
    • 提供者:BOBO
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