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  1. ioiki

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  2. 33实验三十三:利用程序实现ADC_TLC549采样-In 33 experiments: Thirty-three using the program ADC_TLC549sampling
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.78mb
    • 提供者:钟安
  1. SOPC_LCD_EP3C40F780C8

    0下载:
  2. 里面有SOPC硬件工程和软件,为lcd触摸屏控制程序,开发平台FPGA-There are SOPC hardware engineering and software, for LCD touch screen control procedures, development platform FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2.09mb
    • 提供者:张军
  1. fre_dem

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  2. 分频器设计,使用VHDL 语言,一个输入一个输出,CPLD-frequency demultiplication
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:51.8kb
    • 提供者:shanshan lei
  1. counter60

    0下载:
  2. 60位计数器,用于倒计时,计时满后有进位。可用于CPLD交通灯设计计时-60 counter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:50.39kb
    • 提供者:shanshan lei
  1. decoder

    0下载:
  2. 7位译码器,将整数0到9译码用于LED7位数码管显示-decoder, use for 7-bit LED display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:36.38kb
    • 提供者:shanshan lei
  1. fenwei

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  2. 一个分位器,将一个两位数分位两个个位数,方便于分位显示-divided a double digit into two unit
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:57.13kb
    • 提供者:shanshan lei
  1. EX3

    0下载:
  2. 一个简单的EDA设计,显示4个数码管,根据时钟的频率计数-A simple EDA design, 4 digital tube, according to the frequency of the clock count
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:201.78kb
    • 提供者:风平浪静
  1. IR

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  2. FPGA实现的红外IR解码程序,已成功通过Quartus编译,可实现红外正确接收和数据解码提取。-This is a verilog IR decoding program. It has been already compiler through the QuartusII.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:2.38kb
    • 提供者:水之乡
  1. 2

    0下载:
  2. LCD显示,图片和时间以及文字,并能够在笑键盘上输入并显示-LCD display, pictures and time, as well as text, and able to laugh on the keyboard input and display
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:768.41kb
    • 提供者:陈占峰
  1. Four-FPGA-design-techniques

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  2. FPGA设计的四种常用思想与技巧,包括乒乓操作、串并转换、流水线操作、数据接口同步化-FPGA design of the four common ideas and techniques, including the operation of ping-pong, SERDES, pipelining, synchronization of data interface
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-07-28
    • 文件大小:106kb
    • 提供者:function wu
  1. FloatingPoint-Adder

    0下载:
  2. Implementation of 32-bits Floating Point Adder, based on IEEE 754 Standard
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.48kb
    • 提供者:Sohail
  1. FloatingPointMultiplier

    0下载:
  2. Implementation of 32-bits Floating Point Multiplier, based on IEEE 754 Standard
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.36kb
    • 提供者:Sohail
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