资源列表
S6_VGA_change
- verilog源代码，quartusII工程。程序实现VGA时序。控制VGA显示器输出图形。在quartusII中客直接运行，
Chapter4
- 通信IC设计配套的第四章代码，供学习参考使用The codes of Chapter3 of《Communication IC Design》-The codes of Chapter4 of《Communication IC Design》
sdram_mdl
- 基于verilog的SDRAM读写控制,源自特权同学-SDRAM controller use to read or write base on verilog，it is from teqian
xilinx-tcl
- Xilinx脚本约束手册，从官方直接拿到的，对Xilinx FPGA开发很有用的。-Xilinx tcl handbook, directly got Xilinx。
vga
- 基于Spartan-3E FPGA开发板 vga显示设计-Spartan-3E FPGA based development board vga display design
amerikan
- This an hours Verilog-This is an hours Verilog
e10
- 清华大学电子工程系 帧同步器设计实验报告 起始状态定为失步态，通过帧同步码来判断帧的正确性。判断正确则进入预同步态。然后再连续判断两次帧同步码，正确则进入同步态。如果随后的帧的帧头是错误的，则进入保持态以防误码造成的错误。只有在连续发现三次帧头错误才返回失步态。-Electronic Engineering, Tsinghua University, frame synchronizer design experiments starting status report as loss of
8-bit-CPU
- This is a simple 8-bit CPU verilog source code,which includes user s guide.
xilinx_fpga
- 赛林思fpga开发实例包括verilog语言和vhdl语言-The Sailin Si fpga development Examples include the verilog language and vhdl language
led
- 流水灯实验，实现四位流水灯功能 本次的设计主要是一个简单流水灯驱动程序，要求流水灯模式 如下：（1）复位时，灯全部熄灭。（2）复位按键放开时，首先点亮 第一个灯，然后第一个 灯熄灭，同时点亮第二个灯；接着，第二个 灯熄灭，同时点亮第三个灯；再然后，第三个灯熄灭，同时点亮第四 个灯；最后，第四个灯熄灭，同时点亮第一个灯；如此循环往复，实 现流水。(Running water lamp experiment to realize the function of four bit flow
FPGA13_SDRAM
- 基于FPGA Verilog SDRAM 单字通讯-Based on the FPGA Verilog SDRAM words communication
ddc_FPGA
- 简要介绍了数字下变频的设计，通过采用xilinx的ise软件，ipcore的调用实现-Briefly introduced the design of digital down conversion, through the use of ise the xilinx software, ipcore call the realization of