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  1. COFDMFPGA

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  2. TDD双向无线移动传输系统是在整合最新4G技术、LTE技术优势的基础上,自主研发设计的最新一代高速无线网络数据传输设备,能够在“高速运动中”、“非视距条件下”实现高速实时双向传输。TDD双向无线移动传输系统为满足多个移动远端与主控端之间的双向宽带多媒体和数据通信需求而设计,是运动中综合业务如语音、数据、高质量图像双向传输的最佳选择。传输性能指标达到国际领先,适合无线环境复杂、覆盖范围大、通信质量有保障的特定行业应用。-no
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.82mb
    • 提供者:刘金华
  1. CPU

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  2. quartus7.2下以VHDL编程,分为多个模块,在链接原理图中编译。-quartus7.2 next to VHDL programming is divided into multiple modules, compile the schematic in the link.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1.82mb
    • 提供者:xy
  1. new_uart

    0下载:
  2. 串口的调试程序,可用串口调试助手对串口进行收发数据的检测-Debugger serial, serial debugging assistant available to detect the serial data transceiver
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.82mb
    • 提供者:ljp
  1. 2DPSK

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  2. vhdl,Digital phase modulation is also known as phase shift keying, 2DPSK is binary differential phase shift keying, is a kind of digital phase modulation. Digital phase modulation using carrier phase change to transmit digital signal, usually can be
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.82mb
    • 提供者:乐逍遥
  1. CAN总线,I2C,USB等的FPGA实现源码

    0下载:
  2. 控制器局域网总线协议的Verilog代码(The Verilog code of the CAN bus protocol)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-29
    • 文件大小:1.82mb
    • 提供者:walawalapi
  1. baud

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  2. UART 异步通信串口协议的VHDL实现包括3个基本模块:时钟分频、接收模块和发送模块-UART asynchronous serial interface protocol VHDL consists of three basic modules: clock divider, the receiver module and transmit module
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.82mb
    • 提供者:songjie
  1. iicbus

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  2. fpga nios iic gprs verilog 设计-fpga nios iic gprs verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.82mb
    • 提供者:zyc
  1. washing-machine-control

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  2. 基于VHDL的洗衣机洗涤控制电路设计。洗衣机有强洗、标准、轻柔三种洗涤模式;三种洗涤定时;上电复位后的初始设定;启/停控制;洗涤定时精度。可在FPGA上实现。-VHDL-based washing machine control circuit design. Washing machine to wash with strong, standards, gentle washing three kinds of models three kinds of washing time afte
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1.82mb
    • 提供者:
  1. traffic

    0下载:
  2. Traffic Light Controller
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.82mb
    • 提供者:nilesh
  1. vlsi

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  2. VLSI BASED APPLICATION
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.82mb
    • 提供者:ishu
  1. FPGA__source-code__Verilog

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  2. FPGA部分基础功能源代码,适合初学者进行学习仿真,代码可读性强,通俗易懂,逻辑清晰。包括触发器,全加器,分频,并串转换,计数器,序列发生器等Verilog语言源代码。- Part of the basic functions of the source code for FPGA.Suitable for beginners to learn the simulation, the code readable, easy to understand, clear logic. Includ
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1.82mb
    • 提供者:张秋爽
  1. ad7606_evalboard

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  2. 在nios2中实现对AD7606的采样控制(Sampling control of AD7606 in nios2)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-22
    • 文件大小:1.82mb
    • 提供者:magicyang1986
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