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  1. rom123

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  2. 利用ise中的ip核,实现rom的基本功能,通过此程序,学习掌握rom的工作原理及特性-In ise the, using ip core, implement basic functions of the rom and learning to master the working principle and characteristics of the rom
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:451.82kb
    • 提供者:王碧琳
  1. con_ram_success

    0下载:
  2. 利用ise中的ip核,实现在任意地址存储和读取数据-In the ise, using ip core, arbitrary address storing and reading data
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1.75mb
    • 提供者:王碧琳
  1. ECE572_SS

    0下载:
  2. 扩频通信开源项目接收机的源码,对于工程很有帮助,附带说明文档ppt-Source spread spectrum communication receiver open source projects for engineering helpful, with documentation ppt
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:805.7kb
    • 提供者:zhangmingcheng
  1. uart

    0下载:
  2. 基于FPGA的串口调试,亲测无错误,用串口调试工具可直接实现!-FPGA-based serial debugging, pro-test error, with serial debugging tools can be directly implemented!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:493.98kb
    • 提供者:李骏
  1. lvds_tset

    0下载:
  2. 基于FPGA的LVDS接口调试,简单易懂,调试过无错误!-FPGA-based LVDS interface debugging
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2.71mb
    • 提供者:李骏
  1. random

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  2. 伪随机序列应用设计,应用与产生伪随机序列,FPGA实现-Pseudo-random sequence application design, application and generate a pseudo-random sequence, FPGA realization
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:873byte
    • 提供者:吴敏
  1. div

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  2. 除法器设计,基于FPGA,实现除法运算,在实物上测试通过-Divider design, based on FPGA, to achieve the division on the physical test
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.5kb
    • 提供者:吴敏
  1. GF-(q)-multiplier-design

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  2. 伽罗华域GF(q)乘法器设计,FPGA实现-Galois field GF (q) multiplier design, FPGA realization
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.29kb
    • 提供者:吴敏
  1. Common-multiplier-design

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  2. 常用乘法器设计,用FPGA能实现,值得下载。-Common multiplier design, FPGA can achieve, it is worth downloading.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:2.19kb
    • 提供者:吴敏
  1. Common-adder-design-fpga

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  2. 常用加法器设计,用FPGA实现,任何版本都能实现-Common adder design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:3.07kb
    • 提供者:吴敏
  1. UART_test

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  2. EP2S90 进行RS232 通信的一种高效率算法的程序-An efficient algorithm for EP2S90 RS232 communication procedures
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3.25mb
    • 提供者:fengdasa
  1. FIFO_test

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  2. EP2S90 与 TMS320C6727 进行32位通信时读写FIFO的程序,测试完美通过-EP2S90 read FIFO is performed with the TMS320C6727 32-bit communications program, a perfect test by
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-19
    • 文件大小:4.92mb
    • 提供者:fengdasa
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