文件名称:RISC_CPU
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- 上传时间:2012-11-16
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Verilog写的简单处理器QuartusII下可编译
//指令 操作码 源寄存器 目的寄存器 操作
// NOP 0000 xxxxx xxxxxx 空操作
//ADD 0001 src dest dest<=src+dest
//SUB 0010 src dest dest<=dest-src
//AND 0011 src dest dest<=src&&dest
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//WR 0110 src xxxxx memory[Add_R]<=src
//BR 0111 xxxxx xxxxx PC<=memory[Add_R]
//BRZ 1000 xxxxx xxxxx PC<=memory[Add_R]
//HALT 1111 xxxxx xxxxx 挂起至RST-Verilog写的简单处理器QuartusII下可编译
//指令 操作码 源寄存器 目的寄存器 操作
// NOP 0000 xxxxx xxxxxx 空操作
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//HALT 1111 xxxxx xxxxx 挂起至RST
//指令 操作码 源寄存器 目的寄存器 操作
// NOP 0000 xxxxx xxxxxx 空操作
//ADD 0001 src dest dest<=src+dest
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//AND 0011 src dest dest<=src&&dest
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//BRZ 1000 xxxxx xxxxx PC<=memory[Add_R]
//HALT 1111 xxxxx xxxxx 挂起至RST-Verilog写的简单处理器QuartusII下可编译
//指令 操作码 源寄存器 目的寄存器 操作
// NOP 0000 xxxxx xxxxxx 空操作
//ADD 0001 src dest dest<=src+dest
//SUB 0010 src dest dest<=dest-src
//AND 0011 src dest dest<=src&&dest
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//RD 0101 xxxxx dest dest<= memory[Add_R]
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下载文件列表
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RISC_CPU/RISC_CPU.pof
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RISC_CPU/RISC_CPU.qws
RISC_CPU/RISC_CPU.sim.rpt
RISC_CPU/RISC_CPU.sof
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RISC_CPU/test_RISC_CPU.v.bak
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