文件名称:DDS_Adder
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所属分类:
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- 上传时间:2012-11-16
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文件大小:4.73kb
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DDS加法程序,用verilog程序写成,在FPGA的中实现-DDS addition procedures, written with verilog program, implemented in the FPGA' s
(系统自动生成,下载前可以参看下载内容)
下载文件列表
DDS_Adder.v
Wr_LCD.v
Rd_Lcd.v
TWO_PORT.v
TWO_PORT_bb.v
ls393.v
Wr_LCD.v
Rd_Lcd.v
TWO_PORT.v
TWO_PORT_bb.v
ls393.v
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