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文件名称:ddsforsinandcos
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- 上传时间:2012-11-16
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文件大小:843byte
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利用VerilogHDL调用MATLAB产生的数据实现基于DDS技术的正余弦信号发生器,输出位宽为16。-Using the data generated VerilogHDL call MATLAB implementation is based on DDS technology cosine signal generator, the output is 16 bits wide.
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ddsforsinandcos.v
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