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文件名称:ser_para
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所属分类：
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- 上传时间：2012-11-16
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文件大小：1.96kb
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已下载：0次
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相关连接：无下载说明：别用迅雷下载，失败请重下，重下不扣分！
介绍说明－－下载内容来自于网络，使用问题请自行百度
用verilog语言来实现并串转换模块，并行输入八个10位，串行输出一个10位。-achieve and serial converter module verilog
(系统自动生成,下载前可以参看下载内容)
下载文件列表
shift1.v
ser_para.v
ser_para.v
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