文件名称:verilog_multiplier
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verilog实现16*16位乘法器，带测试文件-verilog achieve 16 * 16 multiplier, with test documents
(系统自动生成,下载前可以参看下载内容)
下载文件列表
multiplier/coregen/coregen.cgp
multiplier/coregen/multi_16x16.edn
multiplier/coregen/multi_16x16.v
multiplier/coregen/multi_16x16.veo
multiplier/coregen/multi_16x16.xco
multiplier/coregen/multi_16x16_flist.txt
multiplier/coregen/multi_16x16_readme.txt
multiplier/coregen/tmp/_cg
multiplier/coregen/tmp
multiplier/coregen
multiplier
www.dssz.com.txt
multiplier/coregen/multi_16x16.edn
multiplier/coregen/multi_16x16.v
multiplier/coregen/multi_16x16.veo
multiplier/coregen/multi_16x16.xco
multiplier/coregen/multi_16x16_flist.txt
multiplier/coregen/multi_16x16_readme.txt
multiplier/coregen/tmp/_cg
multiplier/coregen/tmp
multiplier/coregen
multiplier
www.dssz.com.txt
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