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文件名称:verilog-encoder

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    24.3kb
  • 已下载：
    2次
  • 提 供 者：
    林****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

JPEG的編碼器

使用VERILOG以硬體實現

也使用MODEL模擬驗證-JPEG encoder using the VERILOG hardware implementation is also used to simulate authentication MODEL
相关搜索： jpeg verilog

(系统自动生成,下载前可以参看下载内容)

下载文件列表

rtl/add.v
rtl/barrel_shifter.v
rtl/cactable.v
rtl/csa4.v
rtl/csa5.v
rtl/csa51.v
rtl/csa52.v
rtl/csa6.v
rtl/dcdiff_htable.v
rtl/dct.v
rtl/dctctl.v
rtl/dct_1d.v
rtl/dqram64.v
rtl/FA0.v
rtl/FA1.v
rtl/FA2.v
rtl/FA5.v
rtl/jpegctl.v
rtl/JPEGen.v
rtl/lactable.v
rtl/packer.v
rtl/qram64.v
rtl/scc2.v
rtl/scc4.v
rtl/sfifo.v
rtl/sizetable.v
rtl/smul.v
rtl/sub.v
rtl/transram64.v
rtl/vlcctl.v
rtl/zzscan.v
rtl

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