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文件名称:uart_verilog

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    98.91kb
  • 已下载：
    0次
  • 提 供 者：
    mer***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

本工程主要是设计UART接收模块,UART发送模块以及通过COM口接收数据后又发送给PC的uart模块。-The project is mainly designed to UART receiver module, UART transmit module and receive data through COM port and then sent to the PC uart module.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

uart_verilog/
uart_verilog/rcvr.bsf
uart_verilog/rcvr.v
uart_verilog/segmain.bsf
uart_verilog/segmain.v
uart_verilog/segmain.v.bak
uart_verilog/setup.tcl
uart_verilog/setup.tcl.bak
uart_verilog/txmit.bsf
uart_verilog/txmit.v
uart_verilog/uart.bsf
uart_verilog/uart.v
uart_verilog/uart_send.bsf
uart_verilog/uart_send.v
uart_verilog/uart_v.asm.rpt
uart_verilog/uart_v.bdf
uart_verilog/uart_v.done
uart_verilog/uart_v.dpf
uart_verilog/uart_v.fit.rpt
uart_verilog/uart_v.fit.smsg
uart_verilog/uart_v.fit.summary
uart_verilog/uart_v.flow.rpt
uart_verilog/uart_v.map.rpt
uart_verilog/uart_v.map.smsg
uart_verilog/uart_v.map.summary
uart_verilog/uart_v.pin
uart_verilog/uart_v.pof
uart_verilog/uart_v.qpf
uart_verilog/uart_v.qsf
uart_verilog/uart_v.qws
uart_verilog/uart_v.sof
uart_verilog/uart_v.tan.rpt
uart_verilog/uart_v.tan.summary

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