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文件名称:Integrator-comb_timing-state

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    1.87kb
  • 已下载：
    0次
  • 提 供 者：
    李***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
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失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

积分梳状滤波器和时序状态机的Verilog语言描述，适合硬件描述初学者-Integrator-comb filter and timing the Verilog language to describe state machines, hardware descr iption suitable for beginners
(系统自动生成,下载前可以参看下载内容)

下载文件列表

时序状态机/mealy_fsm1.v
时序状态机/mealy_fsm2.v
积分梳状滤波器(CIC)设计/cic3_decimator.v
时序状态机
积分梳状滤波器(CIC)设计

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