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文件名称:VerilogTest

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    101.05kb
  • 已下载：
    0次
  • 提 供 者：
    流***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

FPGA Verilog 小测试程序，仅供参考。

用于学习。-FPGA Verilog small test program for reference purposes only. For learning.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

VerilogTest
VerilogTest/test1.qpf
VerilogTest/test1.qsf
VerilogTest/db
VerilogTest/db/test1.db_info
VerilogTest/db/test1.sim.cvwf
VerilogTest/db/prev_cmp_test1.sim.qmsg
VerilogTest/db/test1.sim.rdb
VerilogTest/db/test1.sim.qmsg
VerilogTest/db/test1.eco.cdb
VerilogTest/db/prev_cmp_test1.map.qmsg
VerilogTest/db/test1.sim.hdb
VerilogTest/db/prev_cmp_test1.fit.qmsg
VerilogTest/db/prev_cmp_test1.asm.qmsg
VerilogTest/db/prev_cmp_test1.tan.qmsg
VerilogTest/db/prev_cmp_test1.eda.qmsg
VerilogTest/db/test1.map.qmsg
VerilogTest/db/test1.sld_design_entry.sci
VerilogTest/db/test1.(0).cnf.cdb
VerilogTest/db/test1.cmp.rdb
VerilogTest/db/test1.(0).cnf.hdb
VerilogTest/db/test1.map.cdb
VerilogTest/db/test1.cbx.xml
VerilogTest/db/test1.rtlv.hdb
VerilogTest/db/test1.rtlv_sg_swap.cdb
VerilogTest/db/test1.pre_map.hdb
VerilogTest/db/test1.pre_map.cdb
VerilogTest/db/test1.map.logdb
VerilogTest/db/test1.rtlv_sg.cdb
VerilogTest/db/test1.sgdiff.hdb
VerilogTest/db/test1.fit.qmsg
VerilogTest/db/test1.cmp.logdb
VerilogTest/db/test1.asm.qmsg
VerilogTest/db/test1.sgdiff.cdb
VerilogTest/db/test1.hif
VerilogTest/db/test1.tan.qmsg
VerilogTest/db/test1.eda.qmsg
VerilogTest/db/test1.hier_info
VerilogTest/db/test1.cmp.tdb
VerilogTest/db/test1.sld_design_entry_dsc.sci
VerilogTest/db/test1.map.hdb
VerilogTest/db/test1.psp
VerilogTest/db/test1.pss
VerilogTest/db/test1.dbp
VerilogTest/db/test1.cmp.cdb
VerilogTest/db/test1.cmp.hdb
VerilogTest/db/test1.cmp0.ddb
VerilogTest/db/test1.syn_hier_info
VerilogTest/db/test1.rpp.qmsg
VerilogTest/db/test1.sgate.rvd
VerilogTest/db/test1.sgate_sm.rvd
VerilogTest/db/wed.wsf
VerilogTest/db/test1.eds_overflow
VerilogTest/test1.map.summary
VerilogTest/test1.pin
VerilogTest/test1.fit.summary
VerilogTest/test1.pof
VerilogTest/test1.tan.summary
VerilogTest/simulation
VerilogTest/simulation/activehdl
VerilogTest/simulation/activehdl/test1.vo
VerilogTest/simulation/activehdl/test1_v.sdo
VerilogTest/timing
VerilogTest/timing/primetime
VerilogTest/timing/primetime/test1.vo
VerilogTest/timing/primetime/test1_v.sdo
VerilogTest/timing/primetime/test1_pt_v.tcl
VerilogTest/test1_nativelink_simulation.rpt
VerilogTest/test1.done
VerilogTest/test1.vwf
VerilogTest/test1.map.rpt
VerilogTest/test1.fit.rpt
VerilogTest/test1.asm.rpt
VerilogTest/test1.tan.rpt
VerilogTest/test1.eda.rpt
VerilogTest/test1.flow.rpt
VerilogTest/prev_cmp_test1.qmsg
VerilogTest/test1.sim.rpt
VerilogTest/test1.v.bak
VerilogTest/test1.v
VerilogTest/test1.qws

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