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文件名称:exp1.8_Dflipflop

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    267.43kb
  • 已下载：
    0次
  • 提 供 者：
    dav****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用VHDL及verylog语言设计一个D触发器，可以在Quartus II中仿真-Language Design with VHDL and verylog a D flip-flop, the Quartus II simulation in
(系统自动生成,下载前可以参看下载内容)

下载文件列表

exp1.8_Dflipflop/Dflipflop.qsf
exp1.8_Dflipflop/Project/Block1.bdf
exp1.8_Dflipflop/Project/db/Dflipflop.(0).cnf.cdb
exp1.8_Dflipflop/Project/db/Dflipflop.(0).cnf.hdb
exp1.8_Dflipflop/Project/db/Dflipflop.asm.qmsg
exp1.8_Dflipflop/Project/db/Dflipflop.asm_labs.ddb
exp1.8_Dflipflop/Project/db/Dflipflop.cbx.xml
exp1.8_Dflipflop/Project/db/Dflipflop.cmp.bpm
exp1.8_Dflipflop/Project/db/Dflipflop.cmp.cdb
exp1.8_Dflipflop/Project/db/Dflipflop.cmp.ecobp
exp1.8_Dflipflop/Project/db/Dflipflop.cmp.hdb
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exp1.8_Dflipflop/Project/db/Dflipflop.cmp.rdb
exp1.8_Dflipflop/Project/db/Dflipflop.cmp.tdb
exp1.8_Dflipflop/Project/db/Dflipflop.cmp0.ddb
exp1.8_Dflipflop/Project/db/Dflipflop.cmp2.ddb
exp1.8_Dflipflop/Project/db/Dflipflop.db_info
exp1.8_Dflipflop/Project/db/Dflipflop.eco.cdb
exp1.8_Dflipflop/Project/db/Dflipflop.eds_overflow
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exp1.8_Dflipflop/Project/db/Dflipflop.hier_info
exp1.8_Dflipflop/Project/db/Dflipflop.hif
exp1.8_Dflipflop/Project/db/Dflipflop.map.bpm
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exp1.8_Dflipflop/Project/db/Dflipflop.map.qmsg
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exp1.8_Dflipflop/Project/db/Dflipflop.map_bb.hdb
exp1.8_Dflipflop/Project/db/Dflipflop.map_bb.hdbx
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exp1.8_Dflipflop/Project/db/Dflipflop.root_partition.cmp.dfp
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exp1.8_Dflipflop/Project/db/Dflipflop.root_partition.map.atm
exp1.8_Dflipflop/Project/db/Dflipflop.root_partition.map.hdbx
exp1.8_Dflipflop/Project/db/Dflipflop.root_partition.map.info
exp1.8_Dflipflop/Project/db/Dflipflop.rtlv.hdb
exp1.8_Dflipflop/Project/db/Dflipflop.rtlv_sg.cdb
exp1.8_Dflipflop/Project/db/Dflipflop.rtlv_sg_swap.cdb
exp1.8_Dflipflop/Project/db/Dflipflop.sgdiff.cdb
exp1.8_Dflipflop/Project/db/Dflipflop.sgdiff.hdb
exp1.8_Dflipflop/Project/db/Dflipflop.signalprobe.cdb
exp1.8_Dflipflop/Project/db/Dflipflop.sim.cvwf
exp1.8_Dflipflop/Project/db/Dflipflop.sim.hdb
exp1.8_Dflipflop/Project/db/Dflipflop.sim.qmsg
exp1.8_Dflipflop/Project/db/Dflipflop.sim.rdb
exp1.8_Dflipflop/Project/db/Dflipflop.simfam
exp1.8_Dflipflop/Project/db/Dflipflop.sld_design_entry.sci
exp1.8_Dflipflop/Project/db/Dflipflop.sld_design_entry_dsc.sci
exp1.8_Dflipflop/Project/db/Dflipflop.syn_hier_info
exp1.8_Dflipflop/Project/db/Dflipflop.tan.qmsg
exp1.8_Dflipflop/Project/db/Dflipflop.tis_db_list.ddb
exp1.8_Dflipflop/Project/db/Dflipflop.tmw_info
exp1.8_Dflipflop/Project/db/prev_cmp_Dflipflop.asm.qmsg
exp1.8_Dflipflop/Project/db/prev_cmp_Dflipflop.fit.qmsg
exp1.8_Dflipflop/Project/db/prev_cmp_Dflipflop.map.qmsg
exp1.8_Dflipflop/Project/db/prev_cmp_Dflipflop.qmsg
exp1.8_Dflipflop/Project/db/prev_cmp_Dflipflop.sim.qmsg
exp1.8_Dflipflop/Project/db/prev_cmp_Dflipflop.tan.qmsg
exp1.8_Dflipflop/Project/db/wed.wsf
exp1.8_Dflipflop/Project/Dflipflop.asm.rpt
exp1.8_Dflipflop/Project/Dflipflop.bsf
exp1.8_Dflipflop/Project/Dflipflop.done
exp1.8_Dflipflop/Project/Dflipflop.dpf
exp1.8_Dflipflop/Project/Dflipflop.fit.rpt
exp1.8_Dflipflop/Project/Dflipflop.fit.smsg
exp1.8_Dflipflop/Project/Dflipflop.fit.summary
exp1.8_Dflipflop/Project/Dflipflop.flow.rpt
exp1.8_Dflipflop/Project/Dflipflop.map.rpt
exp1.8_Dflipflop/Project/Dflipflop.map.summary
exp1.8_Dflipflop/Project/Dflipflop.pin
exp1.8_Dflipflop/Project/Dflipflop.pof
exp1.8_Dflipflop/Project/Dflipflop.qpf
exp1.8_Dflipflop/Project/Dflipflop.qsf
exp1.8_Dflipflop/Project/Dflipflop.qws
exp1.8_Dflipflop/Project/Dflipflop.sim.rpt
exp1.8_Dflipflop/Project/Dflipflop.sof
exp1.8_Dflipflop/Project/Dflipflop.tan.rpt
exp1.8_Dflipflop/Project/Dflipflop.tan.summary
exp1.8_Dflipflop/Project/Dflipflop.tcl
exp1.8_Dflipflop/Project/Dflipflop.vhd
exp1.8_Dflipflop/Project/Dflipflop.vwf
exp1.8_Dflipflop/Project/pins for Dflipflop.txt
exp1.8_Dflipflop/Verilog File/Dflipflop.v
exp1.8_Dflipflop/Verilog File/Dflipflop_TB.v
exp1.8_Dflipflop/VHDL File/Dflipflop.vhd
exp1.8_Dflipflop/Project/db
exp1.8_Dflipflop/Project
exp1.8_Dflipflop/Verilog File
exp1.8_Dflipflop/VHDL File
exp1.8_Dflipflop

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