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文件名称:sd_models_verilog

  • 所属分类：
    VHDL编程
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    7.95kb
  • 已下载：
    1次
  • 提 供 者：
    j*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

测试过可用的SD仿真模型，VERILOG语言-SD card simulation modle, test OK
(系统自动生成,下载前可以参看下载内容)

下载文件列表

sd_models/sd_defines.v
sd_models/sdModel.v
sd_models/sd_crc_7.v
sd_models/sdio_model.v
sd_models/sd_crc_16.v
sd_models/ramdisk2.hex
sd_models/sd_model.log
sd_models

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