文件名称:memory-controller
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- 上传时间：2012-11-16
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存储控制器，包括CPUside，接口，MEMORY side三个部分，使用verilog语言-This represents the "memory controller" It runs with the assumption that it is being connected to PC100 SDRAM.
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MemoryInterface.v
Memoryside.v
CPUside.v
Memoryside.v
CPUside.v
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