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文件名称:mulitcpu

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    8.47mb
  • 已下载：
    0次
  • 提 供 者：
    徐***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用verilog HDL语言或者VHDL语言来编写，实现多时钟周期CPU的设计。能够完成以下二十二条指定（均不考虑虚拟地址和Cache，并且默认为小端方式）：

add rd, rs, rt

addu rd, rs, rt

addi rt, rs, imm

addiu rt, rs, imm

sub rd, rs, rt

subu rd, rs, rt

nor rd, rs, rt

xori rt, rs, imm

clo

clz

slt rd, rs, rt

sltu rd, rs, rt

slti rt, rs, imm

sltiu rt, rs, imm

sllv rd, rt, rs

sra rd, rt, shamt

blez rs, imm

j target

lwl rt, offset(base)

lwr rt, offset(base)

lw rt, imm(rs)

sw rt, imm(rs)

-Verilog HDL language or VHDL language to write multi-clock cycle of the CPU design. To complete the following 22 specified (not taking into account the virtual address and the Cache and the default Xiaoduan):

add rd, rs, rt

addu rd, rs, rt

addi rt, rs, imm

addiu rt, rs, imm

sub rd, rs, rt

subu rd, rs, rt

of nor rd, rs, rt

xori rt, rs, imm

clo

clz

slt rd, rs, rt

sltu rd, rs, rt

slti rt, rs, imm

sltiu rt, rs, imm

sllv rd, rt, rs

sra rd, rt, shamt

blez rs, imm

j target

lwl rt, offset (base)

lwr rt, offset (base)

lw rt, imm (rs)

sw rt, imm (rs)Undo edits

DictionaryGoogle Translate for Business:Translator ToolkitWebsite TranslatorGlobal Market Finder
(系统自动生成,下载前可以参看下载内容)

下载文件列表

mulitcpu/visio/多周期CPU数据通路.vsd
mulitcpu/visio/指令执行状态转换图.vsd
mulitcpu/代码/ALU.v
mulitcpu/代码/CPU_control.v
mulitcpu/代码/extender.v
mulitcpu/代码/I_type_control.v
mulitcpu/代码/memory.v
mulitcpu/代码/multi_cpu.v
mulitcpu/代码/registers.v
mulitcpu/代码/register_single.v
mulitcpu/代码/R_type_control.v
mulitcpu/代码/selector1.v
mulitcpu/代码/selector32.v
mulitcpu/代码/selector32_3.v
mulitcpu/代码/selector32_4.v
mulitcpu/代码/selector4_3.v
mulitcpu/代码/selector5.v
mulitcpu/代码/shift.v
mulitcpu/multiCPU/ALU.v
mulitcpu/multiCPU/CPU_control.v
mulitcpu/multiCPU/CPU_control.v.bak
mulitcpu/multiCPU/db/multi_cpu.(0).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(0).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(1).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(1).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(10).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(10).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(11).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(11).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(12).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(12).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(13).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(13).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(14).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(14).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(15).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(15).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(16).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(16).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(17).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(17).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(18).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(18).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(19).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(19).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(2).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(2).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(20).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(20).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(21).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(21).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(22).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(22).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(23).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(23).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(24).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(24).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(3).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(3).cnf.hdb
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mulitcpu/multiCPU/db/multi_cpu.(4).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(5).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(5).cnf.hdb
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mulitcpu/multiCPU/db/multi_cpu.(6).cnf.hdb
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mulitcpu/multiCPU/db/multi_cpu.(7).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(8).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(8).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.(9).cnf.cdb
mulitcpu/multiCPU/db/multi_cpu.(9).cnf.hdb
mulitcpu/multiCPU/db/multi_cpu.atom.rvd
mulitcpu/multiCPU/db/multi_cpu.cbx.xml
mulitcpu/multiCPU/db/multi_cpu.cmp.rdb
mulitcpu/multiCPU/db/multi_cpu.cmp_merge.kpt
mulitcpu/multiCPU/db/multi_cpu.db_info
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mulitcpu/multiCPU/db/multi_cpu.fnsim.cdb
mulitcpu/multiCPU/db/multi_cpu.fnsim.hdb
mulitcpu/multiCPU/db/multi_cpu.fnsim.qmsg
mulitcpu/multiCPU/db/multi_cpu.hier_info
mulitcpu/multiCPU/db/multi_cpu.hif
mulitcpu/multiCPU/db/multi_cpu.lpc.html
mulitcpu/multiCPU/db/multi_cpu.lpc.rdb
mulitcpu/multiCPU/db/multi_cpu.lpc.txt
mulitcpu/multiCPU/db/multi_cpu.map.bpm
mulitcpu/multiCPU/db/multi_cpu.map.cdb
mulitcpu/multiCPU/db/multi_cpu.map.ecobp
mulitcpu/multiCPU/db/multi_cpu.map.hdb
mulitcpu/multiCPU/db/multi_cpu.map.kpt
mulitcpu/multiCPU/db/multi_cpu.map.logdb
mulitcpu/multiCPU/db/multi_cpu.map.qmsg
mulitcpu/multiCPU/db/multi_cpu.map_bb.cdb
mulitcpu/multiCPU/db/multi_cpu.map_bb.hdb
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mulitcpu/multiCPU/db/multi_cpu.pre_map.cdb
mulitcpu/multiCPU/db/multi_cpu.pre_map.hdb
mulitcpu/multiCPU/db/multi_cpu.rpp.qmsg
mulitcpu/multiCPU/db/multi_cpu.rtlv.hdb
mulitcpu/multiCPU/db/multi_cpu.rtlv_sg.cdb
mulitcpu/multiCPU/db/multi_cpu.rtlv_sg_swap.cdb
mulitcpu/multiCPU/db/multi_cpu.sgate.rvd
mulitcpu/multiCPU/db/multi_cpu.sgate_sm.rvd
mulitcpu/multiCPU/db/multi_cpu.sgdiff.cdb
mulitcpu/multiCPU/db/multi_cpu.sgdiff.hdb
mulitcpu/multiCPU/db/multi_cpu.sim.cvwf
mulitcpu/multiCPU/db/multi_cpu.sim.hdb
mulitcpu/multiCPU/db/multi_cpu.sim.qmsg
mulitcpu/multiCPU/db/multi_cpu.sim.rdb
mulitcpu/multiCPU/db/multi_cpu.simfam
mulitcpu/multiCPU/db/multi_cpu.sld_design_entry.sci
mulitcpu/multiCPU/db/multi_cpu.sld_design_entry_dsc.sci
mulitcpu/multiCPU/db/multi_cpu.smp_dump.txt
mulitcpu/multiCPU/db/multi_cpu.syn_hier_info
mulitcpu/multiCPU/db/multi_cpu.tis_db_list.ddb
mulitcpu/multiCPU/db/multi_cpu.tmw_info
mulitcpu/multiCPU/db/mux_3nc.tdf
mulitcpu/multiCPU/db/mux_aqc.tdf
mulitcpu/multiCPU/db/mux_ioc.tdf
mulitcpu/multiCPU/db/mux_joc.tdf
mulitcpu/multiCPU/db/prev_cmp_multi_cpu.map.qmsg
mulitcpu/multiCPU/db/prev_cmp_multi_cpu.qmsg
mulitcpu/multiCPU/db/prev_cmp_multi_cpu.sim.qmsg
mulitcpu/multiCPU/db/wed.wsf
mulitcpu/multiCPU/debug/multi_cpu.done
mulitcpu/multiCPU/debug/multi_cpu.flow.rpt
mulitcpu/multiCPU/debug/multi_cpu.map.rpt
mulitcpu/multiCPU/debug/multi_cpu.map.smsg
mulitc

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