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文件名称:jishi999999

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [HTML]
  • 上传时间：
    2012-11-16
  • 文件大小：
    687.15kb
  • 已下载：
    0次
  • 提 供 者：
    张***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

程序实现6位计数器，000000~999999，有一个使能信号en,将使能信号en由FPGA的引脚68接入，使用信号发生器产生方波，en信号为1的时候计数器计数，对于输入方波的幅值调为3.3V，可发现计数器计数一段时间会停止，然后接着计数。-Program six counters, 000000 999999, an enable signal en enable signal en by the FPGA pin 68 access, using the signal generator to produce a square wave, en signal is 1 when the counter count for input square-wave amplitude adjusted to 3.3V, can be found in the counter for some time to stop, and then count.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

复件 999999/999999.vhd
复件 999999/clkhms.bsf
复件 999999/clkhms.vhd
复件 999999/clkhms.vhd.bak
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复件 999999/db/jshu.(0).cnf.hdb
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复件 999999/jshu.map.summary
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复件 999999/jshu.tan.summary
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复件 999999/pl.cmp
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复件 999999/pl.qip
复件 999999/pl.vhd
复件 999999/pl_inst.vhd
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复件 999999/pl_waveforms.html
复件 999999/serv_req_info.txt
复件 999999/程序说明.txt
复件 999999/incremental_db/compiled_partitions
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复件 999999/incremental_db
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