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文件名称:risc_cpu-OK

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    8.65kb
  • 已下载：
    0次
  • 提 供 者：
    Jian****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

夏宇闻 verilog数字系统设计教程源码 第二版，实现了简单的RISC CPU。印刷版有误，已改正。- A simple RISC CPU Verilog HDL source code. Work well.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

risc_cpu OK/accum.v
risc_cpu OK/addr_decode.v
risc_cpu OK/adr.v
risc_cpu OK/alu.v
risc_cpu OK/clk_gen.v
risc_cpu OK/counter.v
risc_cpu OK/cpu.v
risc_cpu OK/cputop.v
risc_cpu OK/datactl.v
risc_cpu OK/machine.v
risc_cpu OK/machinectl.v
risc_cpu OK/ram.v
risc_cpu OK/register.v
risc_cpu OK/rom.v
risc_cpu OK/test1.dat
risc_cpu OK/test1.pro
risc_cpu OK/test2.dat
risc_cpu OK/test2.pro
risc_cpu OK/test3.dat
risc_cpu OK/test3.pro
risc_cpu OK

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