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文件名称:CPLD-code

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    22.23mb
  • 已下载：
    0次
  • 提 供 者：
    刘***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

CPLD开发板实验代码，包括Verilog和VHDL源代码，原理图-CPLD development board experimental code, including Verilog and VHDL source code, schematics
(系统自动生成,下载前可以参看下载内容)

下载文件列表

开发板实验代码/verilog/Buzzer/buzzer.asm.rpt
开发板实验代码/verilog/Buzzer/buzzer.bdf
开发板实验代码/verilog/Buzzer/buzzer.cdf
开发板实验代码/verilog/Buzzer/buzzer.done
开发板实验代码/verilog/Buzzer/buzzer.dpf
开发板实验代码/verilog/Buzzer/buzzer.fit.rpt
开发板实验代码/verilog/Buzzer/buzzer.fit.smsg
开发板实验代码/verilog/Buzzer/buzzer.fit.summary
开发板实验代码/verilog/Buzzer/buzzer.flow.rpt
开发板实验代码/verilog/Buzzer/buzzer.map.rpt
开发板实验代码/verilog/Buzzer/buzzer.map.summary
开发板实验代码/verilog/Buzzer/buzzer.pin
开发板实验代码/verilog/Buzzer/buzzer.pof
开发板实验代码/verilog/Buzzer/buzzer.qpf
开发板实验代码/verilog/Buzzer/buzzer.qsf
开发板实验代码/verilog/Buzzer/buzzer.qws
开发板实验代码/verilog/Buzzer/buzzer.tan.rpt
开发板实验代码/verilog/Buzzer/buzzer.tan.summary
开发板实验代码/verilog/Buzzer/db/buzzer.(0).cnf.cdb
开发板实验代码/verilog/Buzzer/db/buzzer.(0).cnf.hdb
开发板实验代码/verilog/Buzzer/db/buzzer.(1).cnf.cdb
开发板实验代码/verilog/Buzzer/db/buzzer.(1).cnf.hdb
开发板实验代码/verilog/Buzzer/db/buzzer.(2).cnf.cdb
开发板实验代码/verilog/Buzzer/db/buzzer.(2).cnf.hdb
开发板实验代码/verilog/Buzzer/db/buzzer.asm.qmsg
开发板实验代码/verilog/Buzzer/db/buzzer.asm_labs.ddb
开发板实验代码/verilog/Buzzer/db/buzzer.cbx.xml
开发板实验代码/verilog/Buzzer/db/buzzer.cmp.cdb
开发板实验代码/verilog/Buzzer/db/buzzer.cmp.hdb
开发板实验代码/verilog/Buzzer/db/buzzer.cmp.logdb
开发板实验代码/verilog/Buzzer/db/buzzer.cmp.rdb
开发板实验代码/verilog/Buzzer/db/buzzer.cmp.tdb
开发板实验代码/verilog/Buzzer/db/buzzer.cmp0.ddb
开发板实验代码/verilog/Buzzer/db/buzzer.dbp
开发板实验代码/verilog/Buzzer/db/buzzer.db_info
开发板实验代码/verilog/Buzzer/db/buzzer.eco.cdb
开发板实验代码/verilog/Buzzer/db/buzzer.fit.qmsg
开发板实验代码/verilog/Buzzer/db/buzzer.hier_info
开发板实验代码/verilog/Buzzer/db/buzzer.hif
开发板实验代码/verilog/Buzzer/db/buzzer.map.cdb
开发板实验代码/verilog/Buzzer/db/buzzer.map.hdb
开发板实验代码/verilog/Buzzer/db/buzzer.map.logdb
开发板实验代码/verilog/Buzzer/db/buzzer.map.qmsg
开发板实验代码/verilog/Buzzer/db/buzzer.pre_map.cdb
开发板实验代码/verilog/Buzzer/db/buzzer.pre_map.hdb
开发板实验代码/verilog/Buzzer/db/buzzer.psp
开发板实验代码/verilog/Buzzer/db/buzzer.pss
开发板实验代码/verilog/Buzzer/db/buzzer.rtlv.hdb
开发板实验代码/verilog/Buzzer/db/buzzer.rtlv_sg.cdb
开发板实验代码/verilog/Buzzer/db/buzzer.rtlv_sg_swap.cdb
开发板实验代码/verilog/Buzzer/db/buzzer.sgdiff.cdb
开发板实验代码/verilog/Buzzer/db/buzzer.sgdiff.hdb
开发板实验代码/verilog/Buzzer/db/buzzer.signalprobe.cdb
开发板实验代码/verilog/Buzzer/db/buzzer.sld_design_entry.sci
开发板实验代码/verilog/Buzzer/db/buzzer.sld_design_entry_dsc.sci
开发板实验代码/verilog/Buzzer/db/buzzer.syn_hier_info
开发板实验代码/verilog/Buzzer/db/buzzer.tan.qmsg
开发板实验代码/verilog/Buzzer/db/buzzer.tis_db_list.ddb
开发板实验代码/verilog/Buzzer/db/prev_cmp_buzzer.asm.qmsg
开发板实验代码/verilog/Buzzer/db/prev_cmp_buzzer.fit.qmsg
开发板实验代码/verilog/Buzzer/db/prev_cmp_buzzer.map.qmsg
开发板实验代码/verilog/Buzzer/db/prev_cmp_buzzer.qmsg
开发板实验代码/verilog/Buzzer/db/prev_cmp_buzzer.tan.qmsg
开发板实验代码/verilog/Buzzer/MAXII240_570T100C5N_PIN.tcl
开发板实验代码/verilog/Buzzer/song.v
开发板实验代码/verilog/Buzzer/song_top.bsf
开发板实验代码/verilog/Buzzer/song_top.v
开发板实验代码/verilog/CLK_DIV/clk_div.asm.rpt
开发板实验代码/verilog/CLK_DIV/clk_div.cdf
开发板实验代码/verilog/CLK_DIV/clk_div.done
开发板实验代码/verilog/CLK_DIV/clk_div.dpf
开发板实验代码/verilog/CLK_DIV/clk_div.fit.rpt
开发板实验代码/verilog/CLK_DIV/clk_div.fit.smsg
开发板实验代码/verilog/CLK_DIV/clk_div.fit.summary
开发板实验代码/verilog/CLK_DIV/clk_div.flow.rpt
开发板实验代码/verilog/CLK_DIV/clk_div.map.rpt
开发板实验代码/verilog/CLK_DIV/clk_div.map.summary
开发板实验代码/verilog/CLK_DIV/clk_div.pin
开发板实验代码/verilog/CLK_DIV/clk_div.pof
开发板实验代码/verilog/CLK_DIV/clk_div.qpf
开发板实验代码/verilog/CLK_DIV/clk_div.qsf
开发板实验代码/verilog/CLK_DIV/clk_div.qws
开发板实验代码/verilog/CLK_DIV/clk_div.tan.rpt
开发板实验代码/verilog/CLK_DIV/clk_div.tan.summary
开发板实验代码/verilog/CLK_DIV/clk_div.v
开发板实验代码/verilog/CLK_DIV/clk_div.v.bak
开发板实验代码/verilog/CLK_DIV/clk_div_assignment_defaults.qdf
开发板实验代码/verilog/CLK_DIV/db/clk_div.(0).cnf.cdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.(0).cnf.hdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.asm.qmsg
开发板实验代码/verilog/CLK_DIV/db/clk_div.asm.rdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.asm_labs.ddb
开发板实验代码/verilog/CLK_DIV/db/clk_div.cbx.xml
开发板实验代码/verilog/CLK_DIV/db/clk_div.cmp.cdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.cmp.hdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.cmp.kpt
开发板实验代码/verilog/CLK_DIV/db/clk_div.cmp.logdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.cmp.rdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.cmp.tdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.cmp0.ddb
开发板实验代码/verilog/CLK_DIV/db/clk_div.db_info
开发板实验代码/verilog/CLK_DIV/db/clk_div.eco.cdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.fit.qmsg
开发板实验代码/verilog/CLK_DIV/db/clk_div.hier_info
开发板实验代码/verilog/CLK_DIV/db/clk_div.hif
开发板实验代码/verilog/CLK_DIV/db/clk_div.lpc.html
开发板实验代码/verilog/CLK_DIV/db/clk_div.lpc.rdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.lpc.txt
开发板实验代码/verilog/CLK_DIV/db/clk_div.map.cdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.map.hdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.map.logdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.map.qmsg
开发板实验代码/verilog/CLK_DIV/db/clk_div.pre_map.cdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.pre_map.hdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.rtlv.hdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.rtlv_sg.cdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.rtlv_sg_swap.cdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.sgdiff.cdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.sgdiff.hdb
开发板实验代码/verilog/CLK_DIV/db/clk_div.sld_design_entry.sci
开发板实验代码/verilog/CLK_DIV/db/clk_div.sld_d

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