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文件名称:ji_shu_qi

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2013-05-18
  • 文件大小：
    5.23kb
  • 已下载：
    0次
  • 提 供 者：
    徐***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

在QuartusII软件中用Verilog HDL编写的计数器的源代码-Verilog HDL prepared counter with in QuartusII software source code
(系统自动生成,下载前可以参看下载内容)

下载文件列表

计数器/
计数器/mycounter/
计数器/mycounter/mycounter.v
计数器/mycounter/mycounter.vwf
计数器/二进制计数器/
计数器/二进制计数器/BinaryCounter.v
计数器/二进制计数器/BinaryCounter.zip
计数器/格雷码计数器/
计数器/格雷码计数器/GrayCounter.v
计数器/格雷码计数器/GrayCounter.zip
计数器/约翰逊计数器/
计数器/约翰逊计数器/JohnsonCounter.v

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