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文件名称:Lab2_Part1

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2013-07-22
  • 文件大小：
    24.63kb
  • 已下载：
    0次
  • 提 供 者：
    Henn*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

display BCD code(0-9) using 7-segment displays in verilog code. Implements on educational kit Altera MAX7000s EPM7128SLC84-7.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

Lab2_Part1/lab2_part1.asm.rpt
Lab2_Part1/lab2_part1.cdf
Lab2_Part1/lab2_part1.done
Lab2_Part1/lab2_part1.fit.eqn
Lab2_Part1/lab2_part1.fit.rpt
Lab2_Part1/lab2_part1.flow.rpt
Lab2_Part1/lab2_part1.map.eqn
Lab2_Part1/lab2_part1.map.rpt
Lab2_Part1/lab2_part1.pin
Lab2_Part1/lab2_part1.pof
Lab2_Part1/lab2_part1.qpf
Lab2_Part1/lab2_part1.qsf
Lab2_Part1/lab2_part1.qws
Lab2_Part1/lab2_part1.tan.rpt
Lab2_Part1/lab2_part1.tan.summary
Lab2_Part1/lab2_part1.v
Lab2_Part1/seg7.v

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