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文件名称:Verilog-Template

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2013-10-11
  • 文件大小：
    12.75kb
  • 已下载：
    0次
  • 提 供 者：
    s****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

verilog 常用功能模块的实例，代码可以直接复制使用-verilog examples of commonly used function modules, the code can be directly copied using
(系统自动生成,下载前可以参看下载内容)

下载文件列表

Verilog Template/DCM时钟管理.v
Verilog Template/TB复位信号产生.V
Verilog Template/verilog.com_笔记
Verilog Template/verilog.v
Verilog Template/三段式有限状态机.v
Verilog Template/串口发送波特率产生.v
Verilog Template/串口接受波特率产生.V
Verilog Template/信号边沿检测.v
Verilog Template/典型的模块组成方式.v
Verilog Template/双向端口设计.v
Verilog Template/定时器和计数器.v
Verilog Template/异步复位-同步释放.v
Verilog Template/输入信号的时钟同步.v
Verilog Template

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