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文件名称:FPGA_multiplier
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- 上传时间：2013-11-22
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文件大小：706byte
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本源码是用verilog语言编写的FPGA乘法器，可以输入两个8位数据，出输16位结果。-The source code is written in verilog FPGA multiplier, you can enter two 8-bit data, the output 16 results.
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FPGA_multiplier.v
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