文件名称:encode_8B10B
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- 上传时间：2013-12-06
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文件大小：1.52kb
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用verilog编写的8B/10B编码模块。参考了网上的源码，并取消了时序，以纯逻辑实现。将3B/4B、5B/6B两部分单独写成模块，可读性更强-Using verilog 8B/10B encoding module. Online reference source, and canceled the timing, pure logic implementation. The 3B/4B, 5B/6B written two separate modules, more readable
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encode_5B6B.v
encode_8B10B.v
encode_3B4B.v
encode_8B10B.v
encode_3B4B.v
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