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文件名称:dpll
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- 上传时间：2014-04-22
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用verilog编写的全数字锁相环，包括鉴相器，模K计数器，加减脉冲模块和分频模块，都经过验证-verilog based digital phase lock loop design, including phase detector,mode K counter, increment/decrement counter and frequency divider
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dpll/div_8.v
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dpll
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