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文件名称:UART-Verilog-source
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所属分类：
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- 上传时间：2014-07-08
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文件大小：2.9kb
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Verilog编写UART串口例程，实现FPGA与上位机串口通信，利用ASCII码进行大小写转换，在Xilinx Virtex-5开发板测试通过-UART serial routines written in Verilog, FPGA serial communication with the host computer using the ASCII code case conversion, in the Xilinx Virtex-5 development board test
(系统自动生成,下载前可以参看下载内容)
下载文件列表
baud.v
GenesysGeneral.ucf
uart.v
uart_dataprocess.v
uart_rec.v
uart_tb.v
uart_tra.v
GenesysGeneral.ucf
uart.v
uart_dataprocess.v
uart_rec.v
uart_tb.v
uart_tra.v
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