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文件名称:implentation of split radix fft through verilog

  • 所属分类：
    VHDL编程
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2014-09-03
  • 文件大小：
    1.16mb
  • 已下载：
    0次
  • 提 供 者：
    nick91
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

this is a verilog code fro implentation of split radix fft
(系统自动生成,下载前可以参看下载内容)

下载文件列表

压缩包 : DSPIC_final-master.zip 列表
DSPIC_final-master/
DSPIC_final-master/.project
DSPIC_final-master/DSPIC_final.data/
DSPIC_final-master/DSPIC_final.data/constrs_1/
DSPIC_final-master/DSPIC_final.data/constrs_1/fileset.xml
DSPIC_final-master/DSPIC_final.data/runs/
DSPIC_final-master/DSPIC_final.data/runs/impl_1.psg
DSPIC_final-master/DSPIC_final.data/runs/impl_1/
DSPIC_final-master/DSPIC_final.data/runs/impl_1/constrs_in.xml
DSPIC_final-master/DSPIC_final.data/runs/impl_1/impl_1.psg
DSPIC_final-master/DSPIC_final.data/runs/runs.xml
DSPIC_final-master/DSPIC_final.data/runs/synth_1.psg
DSPIC_final-master/DSPIC_final.data/runs/synth_1/
DSPIC_final-master/DSPIC_final.data/runs/synth_1/constrs_in.xml
DSPIC_final-master/DSPIC_final.data/runs/synth_1/sources.xml
DSPIC_final-master/DSPIC_final.data/runs/synth_1/synth_1.psg
DSPIC_final-master/DSPIC_final.data/sim_1/
DSPIC_final-master/DSPIC_final.data/sim_1/fileset.xml
DSPIC_final-master/DSPIC_final.data/sources_1/
DSPIC_final-master/DSPIC_final.data/sources_1/fileset.xml
DSPIC_final-master/DSPIC_final.data/wt/
DSPIC_final-master/DSPIC_final.data/wt/java_command_handlers.wdf
DSPIC_final-master/DSPIC_final.data/wt/project.wpc
DSPIC_final-master/DSPIC_final.data/wt/synthesis.wdf
DSPIC_final-master/DSPIC_final.data/wt/webtalk_pa.xml
DSPIC_final-master/DSPIC_final.data/wt/xsim.wdf
DSPIC_final-master/DSPIC_final.runs/
DSPIC_final-master/DSPIC_final.runs/.jobs/
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_1.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_10.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_11.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_12.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_13.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_14.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_15.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_16.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_17.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_2.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_3.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_4.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_5.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_6.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_7.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_8.xml
DSPIC_final-master/DSPIC_final.runs/.jobs/vrs_config_9.xml
DSPIC_final-master/DSPIC_final.runs/impl_1/
DSPIC_final-master/DSPIC_final.runs/impl_1/ISEWrap.js
DSPIC_final-master/DSPIC_final.runs/impl_1/ISEWrap.sh
DSPIC_final-master/DSPIC_final.runs/impl_1/fft_stage4.tcl
DSPIC_final-master/DSPIC_final.runs/impl_1/htr.txt
DSPIC_final-master/DSPIC_final.runs/impl_1/project.wdf
DSPIC_final-master/DSPIC_final.runs/impl_1/rundef.js
DSPIC_final-master/DSPIC_final.runs/impl_1/runme.bat
DSPIC_final-master/DSPIC_final.runs/impl_1/runme.sh
DSPIC_final-master/DSPIC_final.runs/synth_1/
DSPIC_final-master/DSPIC_final.runs/synth_1/.Vivado Synthesis.queue.rst
DSPIC_final-master/DSPIC_final.runs/synth_1/.vivado.begin.rst
DSPIC_final-master/DSPIC_final.runs/synth_1/.vivado.error.rst
DSPIC_final-master/DSPIC_final.runs/synth_1/ISEWrap.js
DSPIC_final-master/DSPIC_final.runs/synth_1/ISEWrap.sh
DSPIC_final-master/DSPIC_final.runs/synth_1/butterfly.tcl
DSPIC_final-master/DSPIC_final.runs/synth_1/fft_stage4.rds
DSPIC_final-master/DSPIC_final.runs/synth_1/fft_stage4.tcl
DSPIC_final-master/DSPIC_final.runs/synth_1/htr.txt
DSPIC_final-master/DSPIC_final.runs/synth_1/rundef.js
DSPIC_final-master/DSPIC_final.runs/synth_1/runme.bat
DSPIC_final-master/DSPIC_final.runs/synth_1/runme.log
DSPIC_final-master/DSPIC_final.runs/synth_1/runme.sh
DSPIC_final-master/DSPIC_final.runs/synth_1/vivado.jou
DSPIC_final-master/DSPIC_final.runs/synth_1/vivado.pb
DSPIC_final-master/DSPIC_final.sim/
DSPIC_final-master/DSPIC_final.sim/sim_1/
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/LUT_twiddle.v
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/add_32bits_float.v
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/compile.bat
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/compile.sh
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/fft.v
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/flp32_complex_multiplier.v
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/mult_32bits_float.v
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/test_LUT_twiddle.v
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/test_fft_stage.prj
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/test_fft_stage.tcl
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/test_fft_stage_behav.log
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/test_fft_stage_behav.wdb
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/test_flp32_add_sub.v
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/test_mult_32bits_float.v
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/test_num.v
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/testbench.v
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/xelab.log
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/xelab.pb
DSPIC_final-master/DSPIC_final.sim/sim_1/behav/xsim.dir/
DSPIC_final-

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