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文件名称:FIR

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2015-01-13
  • 文件大小：
    161.61kb
  • 已下载：
    0次
  • 提 供 者：
    张***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于Verilog的FIR滤波器的设计，该代码包含完整的工程，可以利用quartus软件直接运行-Design of FIR filter based on Verilog, the code contains a complete project, can use quartus software to run directly
(系统自动生成,下载前可以参看下载内容)

下载文件列表

FIR/db/fir.(0).cnf.cdb
FIR/db/fir.(0).cnf.hdb
FIR/db/fir.cbx.xml
FIR/db/fir.cmp.rdb
FIR/db/fir.cmp_merge.kpt
FIR/db/fir.db_info
FIR/db/fir.hier_info
FIR/db/fir.hif
FIR/db/fir.lpc.html
FIR/db/fir.lpc.rdb
FIR/db/fir.lpc.txt
FIR/db/fir.map.bpm
FIR/db/fir.map.cdb
FIR/db/fir.map.hdb
FIR/db/fir.map.kpt
FIR/db/fir.map.logdb
FIR/db/fir.map.qmsg
FIR/db/fir.map_bb.cdb
FIR/db/fir.map_bb.hdb
FIR/db/fir.map_bb.logdb
FIR/db/fir.pre_map.cdb
FIR/db/fir.pre_map.hdb
FIR/db/fir.rtlv.hdb
FIR/db/fir.rtlv_sg.cdb
FIR/db/fir.rtlv_sg_swap.cdb
FIR/db/fir.sgdiff.cdb
FIR/db/fir.sgdiff.hdb
FIR/db/fir.sld_design_entry.sci
FIR/db/fir.sld_design_entry_dsc.sci
FIR/db/fir.smart_action.txt
FIR/db/fir.syn_hier_info
FIR/db/fir.tis_db_list.ddb
FIR/db/fir.tmw_info
FIR/db/logic_util_heursitic.dat
FIR/fir.done
FIR/fir.flow.rpt
FIR/fir.map.rpt
FIR/fir.map.summary
FIR/fir.qpf
FIR/fir.qsf
FIR/fir.v
FIR/incremental_db/compiled_partitions/fir.db_info
FIR/incremental_db/compiled_partitions/fir.root_partition.map.cdb
FIR/incremental_db/compiled_partitions/fir.root_partition.map.dpi
FIR/incremental_db/compiled_partitions/fir.root_partition.map.hdb
FIR/incremental_db/compiled_partitions/fir.root_partition.map.kpt
FIR/incremental_db/README
FIR/incremental_db/compiled_partitions
FIR/db
FIR/incremental_db
FIR

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