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文件名称:uart

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2016-01-17
  • 文件大小：
    270.26kb
  • 已下载：
    0次
  • 提 供 者：
    Prud*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

本例程是用verilog硬件描述语言在quaryusII环境下开发的串口通信模块，分为发送模块，接受模块和波特率产生模块。-This routine is verilog hardware descr iption language development environment under quartus II serial communication module, divided into send module, receive module and baud rate generator module.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

uart/db/logic_util_heursitic.dat
uart/db/my_uart_top.(0).cnf.cdb
uart/db/my_uart_top.(0).cnf.hdb
uart/db/my_uart_top.(1).cnf.cdb
uart/db/my_uart_top.(1).cnf.hdb
uart/db/my_uart_top.(2).cnf.cdb
uart/db/my_uart_top.(2).cnf.hdb
uart/db/my_uart_top.(3).cnf.cdb
uart/db/my_uart_top.(3).cnf.hdb
uart/db/my_uart_top.asm.qmsg
uart/db/my_uart_top.asm.rdb
uart/db/my_uart_top.asm_labs.ddb
uart/db/my_uart_top.cbx.xml
uart/db/my_uart_top.cmp.cdb
uart/db/my_uart_top.cmp.hdb
uart/db/my_uart_top.cmp.kpt
uart/db/my_uart_top.cmp.logdb
uart/db/my_uart_top.cmp.rdb
uart/db/my_uart_top.cmp.tdb
uart/db/my_uart_top.cmp0.ddb
uart/db/my_uart_top.db_info
uart/db/my_uart_top.eco.cdb
uart/db/my_uart_top.fit.qmsg
uart/db/my_uart_top.hier_info
uart/db/my_uart_top.hif
uart/db/my_uart_top.lpc.html
uart/db/my_uart_top.lpc.rdb
uart/db/my_uart_top.lpc.txt
uart/db/my_uart_top.map.cdb
uart/db/my_uart_top.map.hdb
uart/db/my_uart_top.map.logdb
uart/db/my_uart_top.map.qmsg
uart/db/my_uart_top.pre_map.cdb
uart/db/my_uart_top.pre_map.hdb
uart/db/my_uart_top.rpp.qmsg
uart/db/my_uart_top.rtlv.hdb
uart/db/my_uart_top.rtlv_sg.cdb
uart/db/my_uart_top.rtlv_sg_swap.cdb
uart/db/my_uart_top.sgate.rvd
uart/db/my_uart_top.sgate_sm.rvd
uart/db/my_uart_top.sgdiff.cdb
uart/db/my_uart_top.sgdiff.hdb
uart/db/my_uart_top.sld_design_entry.sci
uart/db/my_uart_top.sld_design_entry_dsc.sci
uart/db/my_uart_top.smart_action.txt
uart/db/my_uart_top.syn_hier_info
uart/db/my_uart_top.tan.qmsg
uart/db/my_uart_top.tis_db_list.ddb
uart/db/my_uart_top.tmw_info
uart/db/prev_cmp_my_uart_top.asm.qmsg
uart/db/prev_cmp_my_uart_top.fit.qmsg
uart/db/prev_cmp_my_uart_top.map.qmsg
uart/db/prev_cmp_my_uart_top.qmsg
uart/db/prev_cmp_my_uart_top.tan.qmsg
uart/incremental_db/compiled_partitions/my_uart_top.root_partition.map.kpt
uart/incremental_db/README
uart/my_uart_rx.v
uart/my_uart_top.asm.rpt
uart/my_uart_top.done
uart/my_uart_top.dpf
uart/my_uart_top.fit.rpt
uart/my_uart_top.fit.smsg
uart/my_uart_top.fit.summary
uart/my_uart_top.flow.rpt
uart/my_uart_top.map.rpt
uart/my_uart_top.map.summary
uart/my_uart_top.pin
uart/my_uart_top.pof
uart/my_uart_top.qpf
uart/my_uart_top.qsf
uart/my_uart_top.qsf.bak
uart/my_uart_top.qws
uart/my_uart_top.tan.rpt
uart/my_uart_top.tan.summary
uart/my_uart_top.v
uart/my_uart_top_assignment_defaults.qdf
uart/my_uart_tx.v
uart/speed_select.v
uart/incremental_db/compiled_partitions
uart/db
uart/incremental_db
uart

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