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文件名称:multiply

  • 所属分类：
    数学计算/工程计算
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2008-10-13
  • 文件大小：
    3.93kb
  • 已下载：
    0次
  • 提 供 者：
    la***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

这是我用verilog hdl语言写的浮点乘法器,用的是基4的booth算法,对于部分积使用了5-2压缩和3-2压缩,欢迎大家指点,也欢迎大家把它改成流水线以提高速度.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

download multiply/bootcoder.v
download multiply/boot_mul.v
download multiply/csa.v
download multiply/tb_bootmul.v
download multiply/tb_mul.v
download multiply/_42c_l.v
download multiply
www.dssz.com.txt

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