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文件名称:串口verilog源代码

  • 所属分类：
    VHDL编程
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2011-03-14
  • 文件大小：
    62.7kb
  • 已下载：
    1次
  • 提 供 者：
    huangjiajun1213
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

串口UARTverilog源代码。包括控制模块、收、发模块。程序全，功能简洁，包含Q2工程
相关搜索： UART verilog

(系统自动生成,下载前可以参看下载内容)

下载文件列表

压缩包 : UART.rar 列表
UART\ClkUnit.v
UART\clk_1_wave0.jpg
UART\clk_pll.v
UART\clk_pll_bb.v
UART\clk_pll_wave0.jpg
UART\control_UART.v
UART\miniUART.v
UART\Rx_Unit.v
UART\test_uart.v
UART\Tx_Unit.v
UART\UART.v
UART

相关说明

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