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文件名称:verilog_sdram_controller_testbench

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2012-10-30
  • 文件大小:
    301.92kb
  • 已下载:
    0次
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  • 下载说明:
    别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容来自于网络,使用问题请自行百度

SDRAM 控制器 ,Verilog版本的,带有完整的SDRAM 仿真模型,testbench等,能够实际使用,并且利于学习-The SDRAM controller is designed for the Virtex V300bg432-6. It s simulated with Micron SDRAM models. The design is verified with backannotated simulation at 125MHz
(系统自动生成,下载前可以参看下载内容)

下载文件列表

verilog/func_sim/func_sim.cfg
verilog/func_sim/func_sim.log
verilog/func_sim/func_sim.vpd
verilog/func_sim/glbl.v
verilog/func_sim/run.bat
verilog/func_sim/run_sim
verilog/func_sim/s.alias
verilog/func_sim/sim.bat
verilog/func_sim/sim.do
verilog/func_sim/src.f
verilog/func_sim/states.alias
verilog/func_sim/string_decode_fn.v
verilog/func_sim/tb_sdrm.v
verilog/micron/bank0.txt
verilog/micron/bank1.txt
verilog/micron/mt48lc1m16a1-8a.v
verilog/micron/mt48lc1m16a1.v
verilog/micron/test.v
verilog/par/run_par
verilog/par/sdrm.edf
verilog/par/sdrm.ucf
verilog/par/sdrm_par.sdf
verilog/par/sdrm_par.v
verilog/post_route/post_route.cfg
verilog/post_route/post_route.log
verilog/post_route/post_route.vpd
verilog/post_route/run_sim
verilog/post_route/sdrm_par.sdf
verilog/post_route/sdrm_par.v
verilog/post_route/string_decode_post_route.v
verilog/post_route/tb_post_route.v
verilog/README
verilog/sim.bat
verilog/src/brst_cntr.v
verilog/src/cslt_cntr.v
verilog/src/define.v
verilog/src/glbl.v
verilog/src/ki_cntr.v
verilog/src/rcd_cntr.v
verilog/src/ref_cntr.v
verilog/src/sdrm.v
verilog/src/sdrmc_state.v
verilog/src/sdrm_t.v
verilog/src/sys_int.v
verilog/src/xilinx/BUFG.v
verilog/src/xilinx/CLKDLL.v
verilog/src/xilinx/glbl.v
verilog/src/xilinx/IBUF.v
verilog/src/xilinx/IBUFG.v
verilog/src/xilinx/IOBUF_F_12.v
verilog/src/xilinx/OBUF_F_12.v
verilog/src/xilinx/OBUF_F_16.v
verilog/src/xilinx/SRL16.v
verilog/src.f
verilog/synth/run_synth
verilog/synth/sdrm.edf
verilog/synth/sdrm.scr
verilog/synth/setup.scr
verilog/src/xilinx
verilog/func_sim
verilog/micron
verilog/par
verilog/post_route
verilog/src
verilog/synth
verilog

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