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文件名称:state2

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    1.05mb
  • 已下载：
    0次
  • 提 供 者：
    a****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用状态机实现密码锁State machine used to achieve code lock-State machine used to achieve code lock
(系统自动生成,下载前可以参看下载内容)

下载文件列表

STATE2/db/lcdfinal.(0).cnf.cdb
STATE2/db/lcdfinal.(0).cnf.hdb
STATE2/db/lcdfinal.(1).cnf.cdb
STATE2/db/lcdfinal.(1).cnf.hdb
STATE2/db/lcdfinal.(2).cnf.cdb
STATE2/db/lcdfinal.(2).cnf.hdb
STATE2/db/lcdfinal.(3).cnf.cdb
STATE2/db/lcdfinal.(3).cnf.hdb
STATE2/db/lcdfinal.(4).cnf.cdb
STATE2/db/lcdfinal.(4).cnf.hdb
STATE2/db/lcdfinal.asm.qmsg
STATE2/db/lcdfinal.asm_labs.ddb
STATE2/db/lcdfinal.cbx.xml
STATE2/db/lcdfinal.cmp.bpm
STATE2/db/lcdfinal.cmp.cdb
STATE2/db/lcdfinal.cmp.ecobp
STATE2/db/lcdfinal.cmp.hdb
STATE2/db/lcdfinal.cmp.logdb
STATE2/db/lcdfinal.cmp.rdb
STATE2/db/lcdfinal.cmp.tdb
STATE2/db/lcdfinal.cmp0.ddb
STATE2/db/lcdfinal.db_info
STATE2/db/lcdfinal.eco.cdb
STATE2/db/lcdfinal.fit.qmsg
STATE2/db/lcdfinal.hier_info
STATE2/db/lcdfinal.hif
STATE2/db/lcdfinal.map.bpm
STATE2/db/lcdfinal.map.cdb
STATE2/db/lcdfinal.map.ecobp
STATE2/db/lcdfinal.map.hdb
STATE2/db/lcdfinal.map.logdb
STATE2/db/lcdfinal.map.qmsg
STATE2/db/lcdfinal.map_bb.cdb
STATE2/db/lcdfinal.map_bb.hdb
STATE2/db/lcdfinal.map_bb.hdbx
STATE2/db/lcdfinal.map_bb.logdb
STATE2/db/lcdfinal.pre_map.cdb
STATE2/db/lcdfinal.pre_map.hdb
STATE2/db/lcdfinal.psp
STATE2/db/lcdfinal.root_partition.cmp.atm
STATE2/db/lcdfinal.root_partition.cmp.dfp
STATE2/db/lcdfinal.root_partition.cmp.hdbx
STATE2/db/lcdfinal.root_partition.cmp.logdb
STATE2/db/lcdfinal.root_partition.cmp.rcf
STATE2/db/lcdfinal.root_partition.map.atm
STATE2/db/lcdfinal.root_partition.map.hdbx
STATE2/db/lcdfinal.root_partition.map.info
STATE2/db/lcdfinal.rtlv.hdb
STATE2/db/lcdfinal.rtlv_sg.cdb
STATE2/db/lcdfinal.rtlv_sg_swap.cdb
STATE2/db/lcdfinal.sgdiff.cdb
STATE2/db/lcdfinal.sgdiff.hdb
STATE2/db/lcdfinal.signalprobe.cdb
STATE2/db/lcdfinal.sld_design_entry.sci
STATE2/db/lcdfinal.sld_design_entry_dsc.sci
STATE2/db/lcdfinal.smp_dump.txt
STATE2/db/lcdfinal.syn_hier_info
STATE2/db/lcdfinal.tan.qmsg
STATE2/db/lcdfinal.tis_db_list.ddb
STATE2/db/lcdfinal.tmw_info
STATE2/db/prev_cmp_lcdfinal.asm.qmsg
STATE2/db/prev_cmp_lcdfinal.fit.qmsg
STATE2/db/prev_cmp_lcdfinal.map.qmsg
STATE2/db/prev_cmp_lcdfinal.qmsg
STATE2/db/prev_cmp_lcdfinal.tan.qmsg
STATE2/lcdfinal.asm.rpt
STATE2/lcdfinal.done
STATE2/lcdfinal.fit.rpt
STATE2/lcdfinal.fit.smsg
STATE2/lcdfinal.fit.summary
STATE2/lcdfinal.flow.rpt
STATE2/lcdfinal.map.rpt
STATE2/lcdfinal.map.smsg
STATE2/lcdfinal.map.summary
STATE2/lcdfinal.pin
STATE2/lcdfinal.pof
STATE2/lcdfinal.qpf
STATE2/lcdfinal.qsf
STATE2/lcdfinal.qsf.bak
STATE2/lcdfinal.qws
STATE2/lcdfinal.sof
STATE2/lcdfinal.tan.rpt
STATE2/lcdfinal.tan.summary
STATE2/lcdfinal.v
STATE2/lcdfinal.v.bak
STATE2/LCDmodule.v
STATE2/LCD_Controller.v
STATE2/LCD_TEST_initial.v
STATE2/LCD_TEST_initial.v.bak
STATE2/passed_lock.v
STATE2/passed_lock.v.bak
STATE2/Reset_Delay.v
STATE2/db
STATE2

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