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文件名称:verilog_sample

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    908.1kb
  • 已下载：
    0次
  • 提 供 者：
    Ngu***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

example code verilog for clock
(系统自动生成,下载前可以参看下载内容)

下载文件列表

verilog_sample/b2d.v
verilog_sample/clock.v
verilog_sample/dongho2.v
verilog_sample/IC74ls47.v
verilog_sample/verilog/dongho.v
verilog_sample/verilog/dongho2.v
verilog_sample/verilog/dongho3.v
verilog_sample/verilog/LAB2.v
verilog_sample/verilog/LAB2/LAB2.asm.rpt
verilog_sample/verilog/LAB2/LAB2.csv
verilog_sample/verilog/LAB2/LAB2.done
verilog_sample/verilog/LAB2/LAB2.dpf
verilog_sample/verilog/LAB2/LAB2.fit.rpt
verilog_sample/verilog/LAB2/LAB2.fit.smsg
verilog_sample/verilog/LAB2/LAB2.fit.summary
verilog_sample/verilog/LAB2/LAB2.flow.rpt
verilog_sample/verilog/LAB2/LAB2.map.rpt
verilog_sample/verilog/LAB2/LAB2.map.summary
verilog_sample/verilog/LAB2/LAB2.pin
verilog_sample/verilog/LAB2/LAB2.pof
verilog_sample/verilog/LAB2/LAB2.qpf
verilog_sample/verilog/LAB2/LAB2.qsf
verilog_sample/verilog/LAB2/LAB2.qsf.bak
verilog_sample/verilog/LAB2/LAB2.qws
verilog_sample/verilog/LAB2/LAB2.sof
verilog_sample/verilog/LAB2/LAB2.tan.rpt
verilog_sample/verilog/LAB2/LAB2.tan.summary
verilog_sample/verilog/LAB2/LAB2.v
verilog_sample/verilog/LAB2/LAB2.v.bak
verilog_sample/verilog/LAB2/db/LAB2.(0).cnf.cdb
verilog_sample/verilog/LAB2/db/LAB2.(0).cnf.hdb
verilog_sample/verilog/LAB2/db/LAB2.(1).cnf.cdb
verilog_sample/verilog/LAB2/db/LAB2.(1).cnf.hdb
verilog_sample/verilog/LAB2/db/LAB2.(2).cnf.cdb
verilog_sample/verilog/LAB2/db/LAB2.(2).cnf.hdb
verilog_sample/verilog/LAB2/db/LAB2.(3).cnf.cdb
verilog_sample/verilog/LAB2/db/LAB2.(3).cnf.hdb
verilog_sample/verilog/LAB2/db/LAB2.(4).cnf.cdb
verilog_sample/verilog/LAB2/db/LAB2.(4).cnf.hdb
verilog_sample/verilog/LAB2/db/LAB2.analyze_file.qmsg
verilog_sample/verilog/LAB2/db/LAB2.asm.qmsg
verilog_sample/verilog/LAB2/db/LAB2.asm_labs.ddb
verilog_sample/verilog/LAB2/db/LAB2.cbx.xml
verilog_sample/verilog/LAB2/db/LAB2.cmp.bpm
verilog_sample/verilog/LAB2/db/LAB2.cmp.cdb
verilog_sample/verilog/LAB2/db/LAB2.cmp.ecobp
verilog_sample/verilog/LAB2/db/LAB2.cmp.hdb
verilog_sample/verilog/LAB2/db/LAB2.cmp.logdb
verilog_sample/verilog/LAB2/db/LAB2.cmp.rdb
verilog_sample/verilog/LAB2/db/LAB2.cmp.tdb
verilog_sample/verilog/LAB2/db/LAB2.cmp0.ddb
verilog_sample/verilog/LAB2/db/LAB2.db_info
verilog_sample/verilog/LAB2/db/LAB2.eco.cdb
verilog_sample/verilog/LAB2/db/LAB2.fit.qmsg
verilog_sample/verilog/LAB2/db/LAB2.hier_info
verilog_sample/verilog/LAB2/db/LAB2.hif
verilog_sample/verilog/LAB2/db/LAB2.map.bpm
verilog_sample/verilog/LAB2/db/LAB2.map.cdb
verilog_sample/verilog/LAB2/db/LAB2.map.ecobp
verilog_sample/verilog/LAB2/db/LAB2.map.hdb
verilog_sample/verilog/LAB2/db/LAB2.map.logdb
verilog_sample/verilog/LAB2/db/LAB2.map.qmsg
verilog_sample/verilog/LAB2/db/LAB2.map_bb.cdb
verilog_sample/verilog/LAB2/db/LAB2.map_bb.hdb
verilog_sample/verilog/LAB2/db/LAB2.map_bb.hdbx
verilog_sample/verilog/LAB2/db/LAB2.map_bb.logdb
verilog_sample/verilog/LAB2/db/LAB2.pre_map.cdb
verilog_sample/verilog/LAB2/db/LAB2.pre_map.hdb
verilog_sample/verilog/LAB2/db/LAB2.psp
verilog_sample/verilog/LAB2/db/LAB2.root_partition.cmp.atm
verilog_sample/verilog/LAB2/db/LAB2.root_partition.cmp.dfp
verilog_sample/verilog/LAB2/db/LAB2.root_partition.cmp.hdbx
verilog_sample/verilog/LAB2/db/LAB2.root_partition.cmp.logdb
verilog_sample/verilog/LAB2/db/LAB2.root_partition.cmp.rcf
verilog_sample/verilog/LAB2/db/LAB2.root_partition.map.atm
verilog_sample/verilog/LAB2/db/LAB2.root_partition.map.hdbx
verilog_sample/verilog/LAB2/db/LAB2.root_partition.map.info
verilog_sample/verilog/LAB2/db/LAB2.rtlv.hdb
verilog_sample/verilog/LAB2/db/LAB2.rtlv_sg.cdb
verilog_sample/verilog/LAB2/db/LAB2.rtlv_sg_swap.cdb
verilog_sample/verilog/LAB2/db/LAB2.sgdiff.cdb
verilog_sample/verilog/LAB2/db/LAB2.sgdiff.hdb
verilog_sample/verilog/LAB2/db/LAB2.signalprobe.cdb
verilog_sample/verilog/LAB2/db/LAB2.sld_design_entry.sci
verilog_sample/verilog/LAB2/db/LAB2.sld_design_entry_dsc.sci
verilog_sample/verilog/LAB2/db/LAB2.syn_hier_info
verilog_sample/verilog/LAB2/db/LAB2.tan.qmsg
verilog_sample/verilog/LAB2/db/LAB2.tis_db_list.ddb
verilog_sample/verilog/LAB2/db/prev_cmp_LAB2.asm.qmsg
verilog_sample/verilog/LAB2/db/prev_cmp_LAB2.fit.qmsg
verilog_sample/verilog/LAB2/db/prev_cmp_LAB2.map.qmsg
verilog_sample/verilog/LAB2/db/prev_cmp_LAB2.qmsg
verilog_sample/verilog/LAB2/db/prev_cmp_LAB2.tan.qmsg
verilog_sample/verilog/dongho2/b2d.v
verilog_sample/verilog/dongho2/b2d.v.bak
verilog_sample/verilog/dongho2/clock.v
verilog_sample/verilog/dongho2/dongho2.asm.rpt
verilog_sample/verilog/dongho2/dongho2.done
verilog_sample/verilog/dongho2/dongho2.dpf
verilog_sample/verilog/dongho2/dongho2.fit.rpt
verilog_sample/verilog/dongho2/dongho2.fit.smsg
verilog_sample/verilog/dongho2/dongho2.fit.summary
verilog_sample/verilog/dongho2/dongho2.flow.rpt
verilog_sample/verilog/dongho2/dongho2.map.rpt
verilog_sample/verilog/dongho2/dongho2.map.summary
verilog_sample/verilog/dongho2/dongho2.pin
verilog_sample/verilog/dongho2/dongho2.pof
verilog_sample/verilog/dongho2/dongho2.qpf
verilog_sample/verilog/dongho2/dongho2.qsf
verilog_sample/verilog/dongho2/dongho2.qsf.bak
verilog_sample/verilog/dongho2/dongho2.sof
verilog_sample/verilog/dongho2/dongho2.tan.rpt
verilog_sample/verilog/dongho2/dongho2.tan.summary
verilog_sample/ver

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