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搜索资源列表

  1. adder

    1下载:
  2. 加法器,简单的加法计算器程序,用vb语言实现-Adder, a simple addition calculator program using vb language implementation
  3. 所属分类:Algorithm

    • 发布日期:2016-04-07
    • 文件大小:5244
    • 提供者:邹诗
  1. ghjk

    0下载:
  2. 十进制加法器 示范的的游侠的序号的的剑客骄傲 到家了库文件发动机阿拉斯加法律-Decimal adder demonstration of the Ranger of the serial number of the swordsman proud home of the library file engine Alaska law
  3. 所属分类:assembly language

    • 发布日期:2017-03-28
    • 文件大小:1829
    • 提供者:孩子
  1. Accumulator

    0下载:
  2. 计算机组成原理实验简单的加法器程序。仅供大家参考。-Computer Composition Theory Experiment a simple adder program. Only for your reference.
  3. 所属分类:Other systems

    • 发布日期:2017-03-29
    • 文件大小:140399
    • 提供者:于洪宇
  1. add

    0下载:
  2. VHDL的初学者可以参考此VHDL加法器,相信会给你带来不小的收获-VHDL beginner can refer to the VHDL adder, I believe will bring you not a small harvest
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:4918
    • 提供者:自由之神
  1. adder32

    0下载:
  2. 原理图输入法制作的32位加法器-adder32
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:483290
    • 提供者:fanpei
  1. myjiafa

    0下载:
  2. 用函数语句实现的加法器-adder-function
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:255752
    • 提供者:fanpei
  1. adder2-bingxing

    0下载:
  2. 2位加法器并行操作-2adder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:174044
    • 提供者:fanpei
  1. adder16

    0下载:
  2. adder16 16位加法器-adder16
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:305414
    • 提供者:fanpei
  1. ADDER

    0下载:
  2. VHDL语言的带控制端口的加法器,实现加法运算。-VHDL language, with a control port of the adder to achieve addition operation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:22685
    • 提供者:piikee
  1. add32

    0下载:
  2. 一个32位超前进位加法器 不一样的算法 简单实用-An 32-bit look-ahead adder not the same as the algorithm
  3. 所属分类:Other systems

    • 发布日期:2017-04-01
    • 文件大小:3102
    • 提供者:asty
  1. Parallel-adder

    0下载:
  2. 并行加法器是一种数位电路,其可进行数字的加法计算。在现代的电脑中,加法器存在于算术逻辑单元(ALU)之中。 加法器可以用来表示各种数值,如:BCD、加三码,主要的加法器是以二进制作运算。-Parallel adder is a digital circuit, which can be calculated the number of addition. In the modern computer, adder exists in the arithmetic logic unit (ALU)
  3. 所属分类:MPI

    • 发布日期:2017-03-24
    • 文件大小:2724
    • 提供者:jlz
  1. add_16bits

    0下载:
  2. 這是16bits加法器,利用verilog程式撰寫-adder-19bts
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:8328
    • 提供者:鍾潤宏
  1. adder

    0下载:
  2. 加法器程式設計,這是利用verilog寫的-adder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:10102
    • 提供者:鍾潤宏
  1. 0下载:
  2. 基于VHDL语言8位加法器设计基于VHDL语言8位加法器设计
  3. 所属分类:Document

    • 发布日期:2017-05-02
    • 文件大小:546398
    • 提供者:fgsg
  1. VHDLonfir

    0下载:
  2. FIR滤波器在VHDL中使用(顺序)PROCESS声明或者是加法器和乘法器的“组件 实例”来实现-FIR filter in VHDL use (in order) PROCESS statement or the adder and the multiplier " component instance" to achieve the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:956
    • 提供者:wangYC
  1. ALU_6502

    0下载:
  2. 这个数据是使用cadence工具来做的8位CPU的全加法器
  3. 所属分类:Compress-Decompress algrithms

    • 发布日期:2017-04-06
    • 文件大小:44113
    • 提供者:msc623
  1. adder32_carry_select

    0下载:
  2. 用Hspice编写的32位超前进位加进位选择快速加法器,经验证速度达0.6ns-An adder32_carry_select nse Hspice.
  3. 所属分类:Other systems

    • 发布日期:2017-04-13
    • 文件大小:1690
    • 提供者:xu
  1. adder

    0下载:
  2. 一个加法器程序,同时里面又有一个测试程序,是学习verilog HDL的好程序。-a adder program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:160140
    • 提供者:赵新
  1. BCD8

    0下载:
  2. BCD码十进制8位加法器,采用超前进位的方法-8-bit decimal BCD adder yards, using look-ahead approach
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:701
    • 提供者:刘骁明
  1. a

    0下载:
  2. 个人整理的关于FIR滤波器、加法器、减法器的verilog程序,供大家下载-It’s about some programs about filter,and some others I‘ll be happy if it s better for you~~~
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-01
    • 文件大小:4438
    • 提供者:SkySeraph
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