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srio_test_1
- xilinx rapidio仿真,xilinx ip core 改核为收费核，用liscense获取核文件，共享个大家学习-xilinx rapidio
VGA_SW_Verilog
- VGA IP硬核设计，通过开关简单控制输出图像，在ISE14.6验证通过。-VGA IP hard-core design, the output image by a simple control switch, ISE14.6 validation.
sprtan6ddr3
- 实现简单控制mcb核,实现p3口写和p5口读的功能。-it help you control the mcb ip
PCIe_Lab(ALTERA-V5PCIe)
- 这一设计实例深入浅出，介绍怎样产生一个Qsys子系统。 您将产生一个含有以下组成的Qsys系统:在Cyclone IV GX收发器入门套件上,设计带嵌入式收发器的Gen1×1硬核IP的 PCI Express IP编译器。 -Qsys system: the Cyclone IV GX Transceiver Starter Kit, designed with embedded transceivers Gen1 × 1 hard IP PCI Express IP compiler.
aurora_bram
- Xilinx SP605评估板 Aurora IP(GTP 简单协议) 核功能验证 调试源代码 chipscope验证通过-Xilinx SP605 Evaluation Kit Aurora IP core functional verification debugging source code and chipscope verified
I2C
- 基于FPGA的IIC IP硬核设计 连接UC系统，用VHDL语言书写
winmail_1792
- Winmail Server 是安全易用全功能的邮件服务器软件,支持SMTP/POP3/IMAP/ WebMail/Pushmail/LDAP(公共地址簿)/SSL安全传输协议/公共邮件夹和公告板/多域/ 发信认证/短信提醒/RBL/SPF/Spam Assassin/中继转发/邮件签核/邮件杀毒/网络硬盘及共享/动态IP和域名/IIS和Apache/Web管理/反垃圾邮件/邮件过滤/别名/邮件监控/邮件网关/邮件备份/邮件撤回/流量统计/ 分布式部署/第三方认证/系统迁移-a easy ema
cf_lib
- 基于zedboard-7000的HDMI FPGA IP控制核-HDMI FPGA IP control core based on Zedboard-7000
PCIe_CIVGX_AVST_On_Chip_Mem
- Altera公司的pcie核，附有调试用的驱动和上位机-pcie hard ip of altera, with driver and debug GUI
ddr
- ddr2控制器设计,适用于xilinx fpga,内含IP软核 -ddr2 controller design for xilinx fpga, embedded IP soft core
DDR3_128M16bit_2Port64bit
- Xilinx spartan6 DDR3驱动，编程语言Verilog，基于MCB硬核。-Xilinx spartan6 DDR3 driver based on MCB ip core,coding by verilog.
eetop.cn_AMBAAHBimportant
- ARM研发的AMBA(Advanced Microcontroller Bus Architecture)提供一 种特殊的机制，可将RISC处理器集成在其它IP芯核和外设中(Advanced Microcontroller Bus Architecture)
02047389
- 蓝牙的一个ip RTL 核,不知道对大家有没有用？谢谢,()
rocetech- 加密方法
- FPGA加密主要有 1.配合第三方加密芯片（如ds180等，通过控制程序复位使能实现） 2.自带加密逻辑硬核(如5/6/7系列中的BbRAM和eFUSE存储密钥实现) 主要讲述一下如何用自带的IP进行加密逻辑。(FPGA encryption mainly 1. With third-party encryption chip (such as ds180, etc., reset by controlling the program to enable) 2. Comes with
modol
- 蓝牙的一个ip RTL 核,不知道对大家有没有用？谢谢,()
AT426-BU-98000-r0p0-00rel0
- Cortex-M3软核,适用于Vivado 2018.2以上版本(Cortex-M3 IP,suitable for the Vivado 2018.3 or later)