CDN加速镜像 | 设为首页 | 加入收藏夹
当前位置: 首页 资源下载 文档资料 软件工程 搜索资源 -

搜索资源列表

  1. m16550a_verilog_rtl

    1下载:
  2. mentor UART IP verilog源码 以通过验证.-mentor UART IP verilog source to the test.
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:26110
    • 提供者:cray
  1. FSM_Westor

    0下载:
  2. 状态机得用法,可以帮助新手了解状态机得用法以及掌握用途-state machine in use, and can help newcomers understand the state machine in use, and control purposes
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:2390
    • 提供者:andyxm
  1. keyscan

    0下载:
  2. 4×4键盘扫描的verilog 代码,在CPLD板上实现
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:1206
    • 提供者:fang zhou
  1. SmartSOPC_Board_Cyclone_1C6

    0下载:
  2. sopc开发板标准NIOSII模块,用于EP1C6Q240C8芯片(FPGA)
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:645466
    • 提供者:石林
  1. aFifo

    0下载:
  2. verylog语言编程,为异步flipflop的程序。具有数据传输功能,数据位数可以用户设定
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:1516
    • 提供者:于玮
  1. mycpu

    0下载:
  2. Quartus II 5.0下写的一个单总线架构的CPU设计,包括控制器、运算器、译码电路等。模拟的时钟脉冲也给出。已经通过Quartus II 5.0运行。可以给需要设计总线架构CPU的同学一点参考。
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:800692
    • 提供者:陈佳
  1. nlint+debussy+modelsim

    0下载:
  2. modelsim + debussy脚本
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:1570
    • 提供者:spy
  1. an500_design_example

    0下载:
  2. 利用MAX II CPLD 实现 NAND 闪存接口
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:192030
    • 提供者:spark
  1. mouse1

    0下载:
  2. PS2鼠标驱动程序,verilog语言书写
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:1474
    • 提供者:chenlei
  1. DE0 Debounce

    0下载:
  2. DE0 SPEC
  3. 所属分类:软件工程

  1. pllverilog 完成pll锁相环的设计

    1下载:
  2. 基于FPGA的程序编写,完成pll锁相环的设计,实验证明次程序是完整的-FPGA-based programming, complete pll PLL design, experiments show that second program is complete
  3. 所属分类:软件工程

    • 发布日期:2017-03-23
    • 文件大小:196934
    • 提供者:wcl
  1. apb.rar

    2下载:
  2. APB master verilog code,APB master verilog code
  3. 所属分类:软件工程

    • 发布日期:2017-04-03
    • 文件大小:1013
    • 提供者:Ajay
  1. booth_multiplier

    0下载:
  2. Booth multiplier written in verilog
  3. 所属分类:Project Design

    • 发布日期:2017-04-01
    • 文件大小:530
    • 提供者:Udit
  1. DDS

    1下载:
  2. 基于DDS原理的正弦信号发生器。用VERILOG语言实现,功能强大。-DDS based on the principle of sinusoidal signal generator. Using Verilog language and powerful.
  3. 所属分类:software engineering

    • 发布日期:2017-03-26
    • 文件大小:558736
    • 提供者:毛华站
  1. generic_fifos

    0下载:
  2. Generic FIFO for use with both xilinx and altera
  3. 所属分类:software engineering

    • 发布日期:2017-03-29
    • 文件大小:40126
    • 提供者:ufz
  1. apb_uart

    7下载:
  2. 基于APB总线的UART详细设计方案和实现-APB-based detailed design and implementation of UART
  3. 所属分类:Project Design

    • 发布日期:2017-03-30
    • 文件大小:22194
    • 提供者:东东
  1. SmartSOPC_Flash_Programmer

    0下载:
  2. nios 嵌入式系统基础教程实验 创建目标板FLASH编程-Nios Embedded System Essentials experiment to create target board FLASH Programming
  3. 所属分类:software engineering

    • 发布日期:2017-05-19
    • 文件大小:5594874
    • 提供者:陈鹏
  1. SmartSOPC_standard_1c6

    0下载:
  2. nios 嵌入式系统基础教程配套实验 定制基于AVALON总线的用户外设实验-Nios Embedded System Essentials custom matching experimental bus-based user peripherals AVALON experiment
  3. 所属分类:software engineering

    • 发布日期:2017-04-03
    • 文件大小:856131
    • 提供者:陈鹏
  1. 02_CPLDxitong

    0下载:
  2. cpld系统 EWB Quartus2编译 电子综合设计试验箱程序-CPLD system compiler EWB Quartus2 chamber electronic integrated design process
  3. 所属分类:software engineering

    • 发布日期:2017-05-23
    • 文件大小:7402306
    • 提供者:罗健
  1. clk4

    0下载:
  2. clk4 时钟分频设计用于FPGA入门设计-clk4 clock divider is designed for FPGA design entry
  3. 所属分类:Project Design

    • 发布日期:2017-04-26
    • 文件大小:14168
    • 提供者:lijie
« 12 3 4 5 6 7 8 9 10 ... 16 »
搜珍网 www.dssz.com