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  1. m16550a_verilog_rtl

    1下载:
  2. mentor UART IP verilog源码 以通过验证.-mentor UART IP verilog source to the test.
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:26110
    • 提供者:cray
  1. FSM_Westor

    0下载:
  2. 状态机得用法,可以帮助新手了解状态机得用法以及掌握用途-state machine in use, and can help newcomers understand the state machine in use, and control purposes
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:2390
    • 提供者:andyxm
  1. keyscan

    0下载:
  2. 4×4键盘扫描的verilog 代码,在CPLD板上实现
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:1206
    • 提供者:fang zhou
  1. SmartSOPC_Board_Cyclone_1C6

    0下载:
  2. sopc开发板标准NIOSII模块,用于EP1C6Q240C8芯片(FPGA)
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:645466
    • 提供者:石林
  1. aFifo

    0下载:
  2. verylog语言编程,为异步flipflop的程序。具有数据传输功能,数据位数可以用户设定
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:1516
    • 提供者:于玮
  1. FPGAnumericDESIGN

    0下载:
  2. FPGA 数字处理
  3. 所属分类:技术管理

    • 发布日期:2008-10-13
    • 文件大小:1568139
    • 提供者:梁强
  1. mycpu

    0下载:
  2. Quartus II 5.0下写的一个单总线架构的CPU设计,包括控制器、运算器、译码电路等。模拟的时钟脉冲也给出。已经通过Quartus II 5.0运行。可以给需要设计总线架构CPU的同学一点参考。
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:800692
    • 提供者:陈佳
  1. nlint+debussy+modelsim

    0下载:
  2. modelsim + debussy脚本
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:1570
    • 提供者:spy
  1. an500_design_example

    0下载:
  2. 利用MAX II CPLD 实现 NAND 闪存接口
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:192030
    • 提供者:spark
  1. mouse1

    0下载:
  2. PS2鼠标驱动程序,verilog语言书写
  3. 所属分类:软件工程

    • 发布日期:2008-10-13
    • 文件大小:1474
    • 提供者:chenlei
  1. FPGA IIR滤波器

    1下载:
  2. 小程序,FPGA设计的
  3. 所属分类:文档资料

    • 发布日期:2011-03-29
    • 文件大小:2013
    • 提供者:peter_ljt
  1. powerpc fapg 调试

    0下载:
  2. powerpc fapg 调试
  3. 所属分类:其它文档

    • 发布日期:2011-04-27
    • 文件大小:1060
    • 提供者:okman310
  1. DE0 Debounce

    0下载:
  2. DE0 SPEC
  3. 所属分类:软件工程

  1. Writing efficient testbenches完整版

    0下载:
  2. Xilinx xapp199参考设计并不全, 这是我自己找到的差的部分,并加了进来。
  3. 所属分类:文档资料

  1. pllverilog 完成pll锁相环的设计

    1下载:
  2. 基于FPGA的程序编写,完成pll锁相环的设计,实验证明次程序是完整的-FPGA-based programming, complete pll PLL design, experiments show that second program is complete
  3. 所属分类:软件工程

    • 发布日期:2017-03-23
    • 文件大小:196934
    • 提供者:wcl
  1. apb.rar

    2下载:
  2. APB master verilog code,APB master verilog code
  3. 所属分类:软件工程

    • 发布日期:2017-04-03
    • 文件大小:1013
    • 提供者:Ajay
  1. true_dual_port_ram_dual_clock

    0下载:
  2. 双端口ram的verilog程序,经过验证,可编译可用,-dual pot ram
  3. 所属分类:IT Hero

    • 发布日期:2017-04-02
    • 文件大小:608
    • 提供者:lee
  1. phase_test

    0下载:
  2. 基于verilog的鉴相器设计,鉴相器是锁相环的一部分,功能是检测两个时钟是否同步-The phase detector based on verilog design, PLL phase detector is part of function is to test whether the two clock synchronization
  3. 所属分类:Document

    • 发布日期:2017-03-29
    • 文件大小:640
    • 提供者:林锋
  1. booth_multiplier

    0下载:
  2. Booth multiplier written in verilog
  3. 所属分类:Project Design

    • 发布日期:2017-04-01
    • 文件大小:530
    • 提供者:Udit
  1. s3esk_cpld_design

    1下载:
  2. Spartan-3E板卡XC2C64A CPLD 的代码-the XC2C64A CPLD on the Spartan-3E Starter Kit boards
  3. 所属分类:Document

    • 发布日期:2017-04-05
    • 文件大小:82995
    • 提供者:songheping
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