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搜索资源列表

  1. spi_V1.0.3

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  2. //说 明:msp430通过模拟的spi驱动flash W25X32 //描 述:用于主函数中直接调用 flash写函数 写入数据 //功 能:写入flash 一个字节数据 flash地址自动加一 //端 口:p7.0 接/CS片选端 , p7.1用于时序脉冲, p7.2 用作MOSI主机输出从机输入 , // p7.3用作MISO主机输入从机输出, // p1.4接/WP写保护引脚 ,此程序里没有用到 所以直接拉高,不用。 // 也可以连写 都试过了
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-03-23
    • 文件大小:30883
    • 提供者:小文
  1. pld MegaWizard Plug-In Manager

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  2. 利用QuartusII的"MegaWizard Plug-In Manager", 设计输入数据宽度是4bit的ADD、SUB、MULT、DIVIDE、COMPARE 把它们作为一个project,DEVICE选用EPF10K70RC240-4,对它们进行 时序仿真,将仿真波形(输入输出选用group)在一页纸上打印出来。 2.利用QuartusII的"MegaWizard Plug-In Manager"中的LPM_
  3. 所属分类:软件工程

    • 发布日期:2016-01-24
    • 文件大小:32214
    • 提供者:李侠
  1. FPGA_SDRAM_PCI

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  2. 一个基于FPGA的PCI数据采集程序,包括SDRAM控制,PCI9054时序控制,开发语言verilog,开发环境quartus-FPGA-based PCI data acquisition procedures, including SDRAM control, PCI9054 timing control, the development of language verilog, development environment quartusII
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2798324
    • 提供者:李国扬
  1. I2C(EEPROM)

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  2. 该驱动程序库包含了I2C总线基本时序以及AT24C系列EEPROM的读写函数。 还包含了常用数据格式变量的保存、读取函数。除了字节读写之外,还可以很方便的向EEPROM里写入和读出整型、浮点数、长整型格式的数据。 要使用该库函数,需要将本文件(AT24C02.c)添加进工程,并在需要调用函数的文件开头处包含"AT24C02.h" 演示程序向AT24C02存储器内部保存1字节、整型数据、长整型数据和 浮点型数据,再将他们依次读出,结果用超级终端显示。如果
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2013-11-26
    • 文件大小:4494
    • 提供者:马海峰
  1. shiyan3niu

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  2. 1.利用FLEX10KE系列(EPM10K100EQC240-1X)的CLOCKBOOST (symbol:CLKLOCK),设计一个2倍频器,再将该倍频器2分频后输出。 对其进行时序仿真。 2.设计一个数据宽度8bit,深度是16的 同步FIFO(读写用同一时钟),具有EMPTY、FULL输出标志。 要求FIFO的读写时钟频率为20MHz, 将1-16连续写入FIFO,写满后再将其读出来(读空为止)。 仿真上述逻辑的时序,将仿真
  3. 所属分类:Windows编程

    • 发布日期:2012-10-25
    • 文件大小:53721
    • 提供者:李侠
  1. ExampleCode_ADC_AD7191

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  2. AD公司AD7191(24位)芯片,使用CPU的IO口模拟SPI时序进行数据采集的代码。-AD Company AD7191 (24 bit) chip, using the CPU-IO SPI port timing simulation data collection code.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-04
    • 文件大小:3032
    • 提供者:lizw
  1. AT24C512

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  2. AT24C512采用IIC串口总线方式进行数据传送,读写数据的时序源代码!-AT24C512 way with IIC serial bus data transfer, read and write data timing source code!
  3. 所属分类:CSharp

    • 发布日期:2017-03-28
    • 文件大小:1410
    • 提供者:lixia
  1. HiSPi_Protocol_Specification_for_MT9M033

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  2. MT9M033芯片的HiSPI编程资料。HiSPi总线是9M033特有的数据传输方式。本资料给出了详细的编程细节、时序、寄存器设置等信息。-MT9M033 chip HiSPI programming information. HiSPi bus is 9M033-specific data transmission. This information gives details of the programming details, timing, register set and other
  3. 所属分类:SCM

    • 发布日期:2016-01-26
    • 文件大小:332800
    • 提供者:letree
  1. AT24C04

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  2. AT24C04采用IIC串口总线方式进行数据传送,读写数据的时序源代码!-AT24C04 way with IIC serial bus data transfer, read and write data timing source code!
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-04-03
    • 文件大小:1408
    • 提供者:lixia
  1. EWBhelp

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  2. 随着电子技术和计算机技术的发展,电子产品已与计算机紧密相连,电子产品的智能化日益完善,电路的集成度越来越高,而产品的更新周期却越来越短。电子设计自动化(EDA)技术,使得电子线路的设计人员能在计算机上完成电路的功能设计、逻辑设计、性能分析、时序测试直至印刷电路板的自动设计。EDA是在计算机辅助设计(CAD)技术的基础上发展起来的计算机设计软件系统。与早期的CAD软件相比,EDA软件的自动化程度更高、功能更完善、运行速度更快,而且操作界面友善,有良好的数据开放性和互换性。   电子工作平台El
  3. 所属分类:Other systems

    • 发布日期:2017-04-16
    • 文件大小:444272
    • 提供者:小马哈
  1. goods_sale_system

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  2. 您需要安装 MS SQL Server 2000 以及 Visual Basic 6.0 SP6 ,否则也许会有某些地方出现问题,甚至无法调试。另外,您还需要进行以下步骤,才能顺利地调试源代码: 1) 进入“数据新建”目录,运行程序 数据新建.exe。该程序提供了一个简单的方法去新建程序需要的数据库和测试数据。在程序中填写正确的SQL服务器信息即可。 2) 前台程序不是我开发的,是一个刚学习VB的同学开发的。我个人建议前台不用去看了,没有值得花费时间的地方。 3)
  3. 所属分类:Shop supermarket software system

    • 发布日期:2017-04-06
    • 文件大小:798627
    • 提供者:jiangyuan
  1. VIA_SoC_DS_VT8430_100

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  2. 威盛8430 SOC芯片的数据手册,包含芯片的介绍 GPIO 上电时序,音视频解码 IIC IIS 内部寄存器。外围中断,LCD接口等-VIA 8430 SOC chip data sheet, including the introduction of chip power GPIO timing, audio and video decoding IIC IIS internal registers. External disruption, LCD interface, etc.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-05-03
    • 文件大小:1165136
    • 提供者:iflyman
  1. XiaYuWen_8_RISC_CPU

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  2. 夏宇闻8位RISC_CPU的完整代码+TESTBENCH(已调试) modelsim工程文件,包括书中所测试的三个程序和相关数据,绝对可用~所有信号名均遵从原书。在论坛中没有找到testbench的,只有一个mcu的代码,但很多和书中的是不一样的,自己改了下下~`````大家多多支持啊~`我觉得书中也还是有些不尽如人意的地方,如clk_gen.v中clk2,clk4是没有用的,assign clk1=~clk再用clk1的negedge clk1来触发各个module也是不太好的,会使时序恶
  3. 所属分类:source in ebook

    • 发布日期:2015-04-10
    • 文件大小:86714
    • 提供者:刘志伟
  1. nrf2401

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  2. 实现nrf2401模块发送和接收的功能,通过iO口模拟时序来写入数据 -NRF2401 modules realize the function of sending and receiving, through analogue timing iO mouth to write data
  3. 所属分类:SCM

    • 发布日期:2017-03-28
    • 文件大小:564206
    • 提供者:谢剑
  1. shifter

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  2. 移位运算器SHIFTER 使用Verilog HDL 语言编写,其输入输出端分别与键盘/显示器LED 连接。移位运算器是时序电路,在J钟信号到来时状态产生变化, CLK 为其时钟脉冲。由S0、S1 、M 控制移位运算的功能状态,具有数据装入、数据保持、循环右移、带进位循环右移,循环左移、带进位循环左移等功能。 CLK 是时钟脉冲输入,通过键5 产生高低电平M 控制工作模式, M=l 时带进位循环移位,由键8 控制CO 为允许带进位移位输入,由键7 控制:S 控制移位模式0-3 ,由键6 控制
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-23
    • 文件大小:129279
    • 提供者:623902748
  1. 39VF6401_www.ic37.com

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  2. 39VF6401的数据手册,里面有其与单片机的典型连接方法,和操作时序。-39VF6401 data manual, which has a connection with a typical single-chip approach, and operation timing.
  3. 所属分类:SCM

    • 发布日期:2017-04-26
    • 文件大小:296156
    • 提供者:hu ke
  1. ps2

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  2. avr单片机实现ps2的时序仿真,包括读数据和写数据两部分,mega8验证-avr Microcontroller ps2 timing simulation, including the reading of the data and write data in two parts, mega8 authentication
  3. 所属分类:SCM

    • 发布日期:2017-03-28
    • 文件大小:1541
    • 提供者:苗显
  1. jiajianfazhiling

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  2. (1)课程设计的题目。(2)设计的目的及设计原理。 (3)根据设计要求给出模型机的逻辑框图。 (4)设计指令系统,并分析指令格式。 (5)设计微程序及其实现的方法(包括微指令格式的设计,后续微地址的产生方法以及微程序入口地址的形成)。 (6)模型机当中时序的设计安排。(7)设计指令执行流程。 (8)给出编制的源程序,写出程序的指令代码及微程序。 (9)说明在使用软件HKCPT的联机方式与脱机方式的实现过程(包括编制程序中每指条令的时序分析,累加器A和有关寄存器、存储器的数
  3. 所属分类:Education soft system

    • 发布日期:2017-03-30
    • 文件大小:804972
    • 提供者:朱良
  1. daima

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  2. 状态机控制AD转换模块 该模块主要实现对MAX197的控制:根据设计需要对芯片进行初始化(包括写控制字选择输入电压值范围、选择通道以及工作模式),并把通道数送指示灯显示以及用键盘控制通道号(按一下,通道号加1,同时点亮相应的指示灯,循环使用个通道);控制状态机的工作时序,并置两次采集到的数据为12位数据输出,并经过锁存进程来锁存数据,最后从锁存器中把输出数据-The state machine controls AD and changes the module this module ma
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:2771
    • 提供者:万俟斌
  1. TKC7524jiekoudianluchengxu

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  2. 根据TLC7524输出控制时序,利用接口电路图,通过改变输出数据,设计一个正弦波发生器。TLC7524是8位的D/A转换器,转换周期为 ,所以锯齿波型数据有256个点构成,每个点的数据长度为8位。.FPGA的系统时钟为 ,通过对其进行5分频处理,得到频率为 的正弦波-TLC7524 output under the control of timing, the use of interface circuit, by changing the output data, the design o
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:972
    • 提供者:离火
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