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  1. fsm

    1下载:
  2. 有限状态机工作原理、设计方法、步骤等精要说明-Finite state machine working principle, design method, such as Essentials of steps to explain
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-10-13
    • 文件大小:3187520
    • 提供者:www
  1. HUAWEI_FPGA

    1下载:
  2. 华为内部资料,华为FPGA全套资料,包括华为的专利设计-Internal information Huawei Huawei FPGA complete information, including Huawei' s patented design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-27
    • 文件大小:10509932
    • 提供者:刘诗友
  1. PrX90Eng

    1下载:
  2. Xerox01/90 limited programmer
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2016-02-17
    • 文件大小:301056
    • 提供者:DS
  1. SPI

    1下载:
  2. 经典spi IP 核心 FPGA是实现有说明文档-spi IP based on fpga
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:49424
    • 提供者:wuyou
  1. verilog_sdram

    1下载:
  2. SDRAM读写控制的实现与Modelsim仿真,采用verilog HDL编写-sdram controller and simulate with modelsim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2175607
    • 提供者:bigchop ma
  1. uart_EP3C16_FIFO

    1下载:
  2. Verilog编写的串口RS232收发字符串程序,使用FIFO作为数据缓冲区,有效收发字符串长度为256字节,解决了利用串口调试工具与FPGA通讯只能收发单字节的问题.-Programs for uart/RS232, it can receive and transmit strings.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-11-10
    • 文件大小:6756352
    • 提供者:515666524
  1. vga_game

    1下载:
  2. 用Verilog写的小游戏,俄罗斯方块,在VGA上实现游戏功能-Verilog game
  3. 所属分类:VHDL编程

    • 发布日期:2013-12-20
    • 文件大小:8686778
    • 提供者:端木微雨
  1. DE2_CCD_sobel

    1下载:
  2. 通过摄像头图像的提取,在FPGA开发板上实现的,主要实现了图像轮廓的提取-Extraction of the image through the camera, in the FPGA implementation of the development board, the main achievement of the image contour extraction
  3. 所属分类:VHDL编程

    • 发布日期:2014-02-25
    • 文件大小:257476
    • 提供者:枫雪
  1. SPWM

    1下载:
  2. VHDL采用自然采样法写的SPWM,里面有正弦表,可以通过外接输入正弦波和三角波的频率。 -VHDL using written natural sampling SPWM, there are sine table, you can enter through the external sinusoidal and triangular wave frequency.
  3. 所属分类:VHDL编程

    • 发布日期:2013-10-17
    • 文件大小:7312
    • 提供者:zyb
  1. armGPRS

    1下载:
  2. Neo_M590 AT指令集_V2.4 GPS-Neo_M590 AT command set _V2.4 information
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:212444
    • 提供者:杨承益
  1. Sequence-detector-design

    1下载:
  2. 序列检测器设计的思路大多都是用FSM来实现的,此思路是通过移位寄存器来实现序列检测-Sequence detector design ideas are often used to achieve the FSM, the idea is to achieve through the shift register sequence detection
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-24
    • 文件大小:31189
    • 提供者:lsp
  1. SDH_module

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  2. SDH帧同步头的检测,并提取其中的语音信息的模块设计-SDH frame sync detection, and extract audio information module design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:353300
    • 提供者:雷伟林
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