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  1. ClkTrans

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  2. 双相电源,能够形成极性相反的两组信号-Bipolar power supply, two group of signals can form the opposite polarity.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:972byte
    • 提供者:guo yanru
  1. TrafficLights

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  2. 红绿灯控制系统,可以同时控制两个独立路口,并且红灯时间可调-the traffic light control system,can control two intersections independently, plus, the time of the red light can be altered
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:621.41kb
    • 提供者:朱先森
  1. Random-number-generator-verilog

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  2. Verilog code for a pseudo random number generator using linear shift registers. Implemented on Basys2 with Xilinx. Project report also is included.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1.12mb
    • 提供者:sndn_shr
  1. oooo

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  2. 基于fpga和51单片机的等精度频率计,通过fpga对信号进行采集,数据传给单片机计算,再由12864进行显示,可进行频率,周期,脉宽,占空比,幅值等的测量。-Fpga and 51 microcontroller based precision frequency meter, through fpga for signal acquisition, data to the microcontroller to calculate, and then by 12864 for display,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1.19mb
    • 提供者:陈伟豪
  1. myproj

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  2. 1) 可以产生四种波形:正弦波,方波,三角波,锯齿波。 2) 实现分频可调,分频比从2~256可调,通过两个按键进行+1和-1的调整。 3) 信号幅度可调,幅度增益从1~4倍可调,过两个按键进行+1和-1的调整。 4) 8位数码管的前3位显示分频比,最后一位显示幅度增益,中间的四位分别代表四种波形是否输出,若输出则显示’1’,否则显示’0’。 5) 可实现四种波形的叠加,当有两种波形叠加时,增益不能超过3,当是四种或三种波形叠加时,增益只能为1. -1) can produc
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:166.87kb
    • 提供者:陈伟豪
  1. PPCCBB

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  2. DVB 系统中两个产品的硬件pcb电路图,完整。如果你想看QPSK调制器和码流复用器。值得你下载.-QPSK MODULATOR
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2.17mb
    • 提供者:ppddr47
  1. FPGA_EP2S90

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  2. ALTERA EP2S90 PCB (8层板)文件,完整的PCB文件,这个东西是公司花大价钱做出来的。如果你正在学习FPGA这个东西值得你收藏的.FPGA硬件开发和软件编程都用的到的-FPGA EP2S901040C4
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-16
    • 文件大小:3.71mb
    • 提供者:ppddr47
  1. SPI_VHDL

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  2. this the simple of CC25oo verilog HDl code for FPGA thank you-this is the simple of CC25oo verilog HDl code for FPGA thank you
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-27
    • 文件大小:19.62kb
    • 提供者:MGWinZ
  1. DPSK

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  2. DPSK调制信号的生成,通过MATLAB生成测试数据,用quartusII软件编译并仿真-DPSK signal
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:395.9kb
    • 提供者:舒占军
  1. fir

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  2. 使用VHAL语言编写的一个fir滤波器,通过modelsim进行仿真-fir filter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:8.48mb
    • 提供者:舒占军
  1. div

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  2. 使用quartusII软件,Verilog语言编写的一个分频器,仿真测试通过- frequency dividing circuit
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:210.9kb
    • 提供者:舒占军
  1. ROM

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  2. 使用Verilog语言编写的ROM,根据ROM逻辑,自己写的一个ROM,并仿真实现功能-read only memory
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-17
    • 文件大小:4.18mb
    • 提供者:舒占军
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