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  1. yanshi.rar

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  2. 给予VHDL的延时函数 是简单的开始时间的延时,VHDL delay to the start of the function is a simple time delay
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:83.44kb
    • 提供者:李建兵
  1. dct.rar

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  2. 离散余弦变换的设计源代码以及测试源代码和仿真图,Design of discrete cosine transform source code and test source code and simulation plan
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:334.44kb
    • 提供者:cong
  1. Fifoed_avalon_uart_9.3

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  2. Altera真正可用的带FIFO的UART组建。-Altera FIFO UART
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:197.07kb
    • 提供者:we
  1. EFA_mentor_keygen_2010

    0下载:
  2. EFA_mentor_keygen_2010.rar,请穷技术人员下载使用,不要用于商业.-EFA_mentor_keygen_2010.rar, please download the poor technical staff, not for business.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:270.69kb
    • 提供者:
  1. UART

    0下载:
  2. FPGA的UART程序,非常好的,讲解详细,我当初看了好多都看不懂,看了这个以后终于明白-FPGA' s UART program, very good, detailed explanation, I had read a lot have not read, finally realized after reading this
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:270.46kb
    • 提供者:xuxing
  1. AD7938controllor-VHDL

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  2. VHDL语言的有限状态机法控制8位/12位自动转换通道模数转换器AD7938-VHDL, FSM method to control 8-bit/12-bit ADC AD7938 auto-conversion channel
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:1.64kb
    • 提供者:
  1. ddsb

    0下载:
  2. DDS波形发生器,通过改变频率控制字来改变输出波形的频率。波形的数据实现存在ROM表中,通过时钟触发来读取。-DDS waveform generator, by changing the frequency control word to change the frequency of the output waveform. The data waveform ROM table to achieve there, triggered by the clock to read.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:728.11kb
    • 提供者:陈杰
  1. 8b10b编解码

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  2. 8b10b编解码,aurora协议,遵照xilinx官网文档-8b10b encoder and decoder, aurora protocol
  3. 所属分类:VHDL编程

    • 发布日期:2017-03-30
    • 文件大小:2.53kb
    • 提供者:weimin
  1. DE2_115_SD_CARD

    0下载:
  2. DE2-115的SD卡读写实验,基于NIOS和C语言编写的代码-DE2-115 SD card reader test, based on NIOS and C language code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2.22mb
    • 提供者:xiao
  1. CPLD_DS18B20

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  2. 基于CPLD的DS18B20温度显示程序,可将采集到的温度值通过16位LED或四位数码管实时显示,同时可任意设定温度上下限,实现蜂鸣器告警(该程序已实测成功,内附DS18B20中文资料)-CPLD-based DS18B20 temperature display program can be collected by temperature or four 16-bit digital tube LED display real-time, while lower temperature ca
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:1.05mb
    • 提供者:CTK
  1. SignalTap-shiyong

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  2. fpga读写sram(61LV25616),程序附详细注释,包含波形仿真文件及signaltap在线调试文件,并附有文档对程序及signaltap的使用进行了详细说明。 -fpga read and write sram (61LV25616), with detailed program notes, including documents and signaltap waveform simulation debug files online, along with documentatio
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-19
    • 文件大小:4.97mb
    • 提供者:郝强
  1. DDR-SDRAM_IP_core

    0下载:
  2. DDR-SDRAM接口模块verilog源代码,可用作IP核使用,已在FPGA上验证-DDR-SDRAM interface module verilog source code, can be used as IP cores to use, proven
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:463.49kb
    • 提供者:zyy
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