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  1. 39VF160

    0下载:
  2. 39VF160 NorFlash驱动,方便ARM开发
  3. 所属分类:微处理器(ARM/PowerPC等)

    • 发布日期:2008-10-13
    • 文件大小:1.32kb
    • 提供者:vvmmd
  1. ATmega8spwm

    0下载:
  2. mega8单片机产生spwm信号的例子,做正弦波变频可以参考。-mega8 SCM signal generated spwm example, do sine wave inverter for reference.
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-11
    • 文件大小:1.32kb
    • 提供者:aidthat
  1. C8051F020P18b20

    0下载:
  2. 温度传感器18B20的keil C51驱动程序-temperature sensor 18B20 the keil C51 Driver
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-04-12
    • 文件大小:1.32kb
    • 提供者:货单程序
  1. nihonddeng

    0下载:
  2. 用VHDL实现16个霓虹灯按照多种方式闪亮.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.32kb
    • 提供者:Jame
  1. dj

    0下载:
  2. 改程序完成对红外万能遥控器的解码。将解码进行存储-Procedures to complete the universal infrared remote control decoder. The decoder to store
  3. 所属分类:Other Embeded program

    • 发布日期:2017-03-30
    • 文件大小:1.32kb
    • 提供者:
  1. delay

    0下载:
  2. this a file used for the spi communication between spi1 and spi2 of dspic30f6014. this file is used for delay.-this is a file used for the spi communication between spi1 and spi2 of dspic30f6014. this file is used for delay.
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-06
    • 文件大小:1.32kb
    • 提供者:valiantyasir
  1. demux

    0下载:
  2. 与多工器功能相反,可将一个位元的资料透过选择分配输出端的其中一个。 -In contrast with the multiplexer function can be a bit of information on the allocation of the output by selecting one of them.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:1.32kb
    • 提供者:李宗晟
  1. _00_Servo_Poten_Control

    0下载:
  2. Motor Control by Potengeometer (Arduino)
  3. 所属分类:Other Embeded program

  1. rtage

    0下载:
  2. SD card test to transmit data
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-12
    • 文件大小:1.32kb
    • 提供者:oussama
  1. AD

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  2. AD采集控制时序,控制对象AD1674启动和转换-AD acquisition control timing, control object AD1674 starts and conversion
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.32kb
    • 提供者:何小
  1. half_band

    0下载:
  2. 半带滤波器verilog源代码,主要用于采样率变换系统中,采用乘法积累加器,很好的例子,供大家参考-Half band filter verilog code, mainly for the sampling rate conversion system, use the multiplication accumulation adder, a good example, for your reference
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.32kb
    • 提供者:张俊
  1. CfgDDS_9910

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  2. dds ad9910配置的verilog hdl程序,模块化设计,输入待配置的数据,字长,启动信号,即可自动产生时序,完成一次配置,模块还有done握手信号,方便用户调用时,反复多次配置。-dds ad9910 configuration verilog hdl program, modular design, the input data to be configured, word length, the start signal, the timing can be automatical
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.32kb
    • 提供者:汪海兵
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