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  1. UART

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  2. 嵌入式UART完整实例程序,是入门程序,对新手入门很有帮助-Examples of embedded UART complete program,introduction to entry procedures
  3. 所属分类:SCM

    • 发布日期:2017-04-16
    • 文件大小:138.7kb
    • 提供者:杨青
  1. PHA

    0下载:
  2. Verilog编写的两路信号的相位测量相关内容,可计算两路信号的相位差,及当前频率-Verilog prepared by the two-way signal phase measurements related content, calculate the phase difference between two signals, and the current frequency
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:748byte
    • 提供者:常艺
  1. Adc

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  2. 嵌入式ARM7AD转换完整程序,比较适合初学者-Embedded ARM7AD conversion complete program, suitable for beginners
  3. 所属分类:Other Embeded program

    • 发布日期:2017-04-04
    • 文件大小:90.84kb
    • 提供者:杨青
  1. ATmega16-PID-PWM-nokia5110

    0下载:
  2. ATmega16 C源程序,ICCAVR PWM电机PID调速,按键控制加减速,nokia5110显示转数-ATmega16 C source code, ICCAVR PWM motor PID speed control, button control acceleration and deceleration, nokia5110 display rotation
  3. 所属分类:SCM

    • 发布日期:2017-04-07
    • 文件大小:250.72kb
    • 提供者:
  1. qicehweideng

    0下载:
  2. 汽车尾灯控制电路的设计,正常行驶时,6个尾灯全灭,刹车时,尾灯按一定频率闪烁,左转时,左侧灯轮流闪烁,右转时,右侧的灯轮流闪烁。-Control circuit design taillights, normal driving, six taillights Quanmie, brake, tail lights flashing at a certain frequency, turn left, turn left flashing lights, turn right, the righ
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.1kb
    • 提供者:wancaihong
  1. shuzihongdianlu

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  2. 数字钟电路的实现,可以24小时计时,可调整时间!-Digital clock circuit implementation, a 24-hour timer, adjustable time!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-27
    • 文件大小:367.33kb
    • 提供者:wancaihong
  1. 4weiquanjiaqi

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  2. 4位全加器由3个模块构成。首先,通过实例引用基本门级元件xor、and定义底层的半加器模块halfadder,接着实例引用两个半加器模块halfadder和一个基本或门元件or组合成为全加器模块fulladder,最后实例引用4个1位的全加器模块fulladder构成4位全加器的顶层模块-4 full adder by the three modules. First, the basic gate-level component instance references xor, and def
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:393.37kb
    • 提供者:wancaihong
  1. jiancedianlu

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  2. 功能是检测出串行输入数据Sin中的4位二进制序列0101(自左至右输入),当检测到该序列时,输出Out=1;没有检测到该序列时,输出Out=0。-Function is to detect the serial input data Sin the 4-bit binary sequence 0101 (from left to right input), when the sequence is detected, the output Out = 1 the sequence is not
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:301.38kb
    • 提供者:wancaihong
  1. _50MHz--1Hz

    0下载:
  2. 分频电路,可将DE2板子上的50MHz分为1Hz输出,绝对可行,附有仿真程序!-Divider circuit can be divided into the DE2 board 1Hz output on 50MHz, absolutely feasible, with a simulation program!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:369.79kb
    • 提供者:wancaihong
  1. baker-code-generator

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  2. 巴克码发生器,VHDL语言描述,可以在quartus II上运行,基于altera-baker code generator
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:286.62kb
    • 提供者:sddxzq
  1. Electronic-funnel-Electronic-funnel

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  2. 一个自己来发的电子漏斗程序,希望有学习的有用-To send an electronic funnel their procedures in the hope of learning useful
  3. 所属分类:SCM

    • 发布日期:2017-04-07
    • 文件大小:25.13kb
    • 提供者:覃奇峰
  1. TLX-1CEVM-GUIDEBOOK

    0下载:
  2. TLX-1C开发板使用手册,完整的介绍,非常详细,适合使用者-TLX-1C development board user manual, complete introduction, very detailed, for users
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-05-09
    • 文件大小:1.71mb
    • 提供者:耿伟
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