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  1. special_crcb

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  2. 一种另类的crc生成办法,改变了流水先结构而使用并行结构。可拓展思路。-An alternative way to generate crc, changing the water first structure to use parallel structures. To develop ideas.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-16
    • 文件大小:3.72mb
    • 提供者:wanzhuan
  1. a

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  2. 基于fpga的vhdl十进制 计数器,简单好用-Decimal counter vhdl fpga-based, easy to use
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:737.96kb
    • 提供者:li
  1. hengwenxiang

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  2. 恒温控制器,由状态机连接到温度传感器,温度控制的控制。该代码是用verilog编写的恒温控制,在每个语句有一个中文的描述-Thermostat controller, controlled by a state machine connected to the temperature sensors, temperature control. The code is written in verilog thermostat control, after each statement has a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.05kb
    • 提供者:刘禹韬
  1. clock

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  2. 有防抖模块的双键数字钟,可实现时分秒调节,24小时计时。-There are double anti-shake digital clock module, minutes and seconds can be achieved when the regulation, 24-hour clock.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.77kb
    • 提供者:刘禹韬
  1. 8bit_multiplier

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  2. 8bit 无符号串联乘法器,由状态机实现,用相加与移位实现乘法功能。-Unsigned 8bit serial multiplier, the state machine implementation, realized by adding the shift multiplication function.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1.35kb
    • 提供者:刘禹韬
  1. syn_fifo_style_1

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  2. verilog实现的,异步FIFO。所有代码在一个模块中。-verilog achieve, asynchronous FIFO. All code in a module.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1015byte
    • 提供者:刘禹韬
  1. syn_fifo_style_2

    0下载:
  2. 由verilog实现的,异步FIFO,分为多模块实现。-Verilog achieved by the asynchronous FIFO, divided into multiple modules.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.35kb
    • 提供者:刘禹韬
  1. mcs51

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  2. 一个与51单片机通讯的简单程序,仿真已经通过!-A simple communication with the microcontroller 51 programs, simulation has been passed!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:742byte
    • 提供者:lilei
  1. ASBoard_restored

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  2. AD采集程序,自己做的,SPI通信协议,多通道采集-AD acquisition procedures, do their own, SPI communication protocol, multi-channel acquisition
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-20
    • 文件大小:5.82mb
    • 提供者:陈照
  1. shift_1x64_vhd

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  2. register shifter of 64bits
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:555byte
    • 提供者:anas
  1. MX25L6445E

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  2. spi flash 驱动程序 verilog-spi flash Driver verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:14.62kb
    • 提供者:
  1. M25PX_64Mb_Device_Driver

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  2. spi flash 驱动程序 c语言,官方发行版-spi flash c driver
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:15.4kb
    • 提供者:
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