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  1. shift

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  2. 该移位寄存器的功能是寄存输入数据,并在控制信号作用下将输入数据移位输出。-The function of the shift register are input data storage, and under the control signal at the input of data output shift.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:38.58kb
    • 提供者:伍家香
  1. VHDLstudyandapplication

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  2. 这是哈尔滨工程大学信息与通信工程学院的VHDL语言及其应用讲义,是初学者学习PFGA好资料。-This is the University of Harbin Engineering Information and Communication Engineering Institute of the VHDL language and its application notes, is good information for beginners PFGA study.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:546.33kb
    • 提供者:wangjundong
  1. myfifo

    0下载:
  2. fifo(1-6:1):using ip-code and rd wd interface-fifo:using ip-code and rd wd interface
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1.92kb
    • 提供者:sunbaoyu
  1. Finit_state_machine_in_C

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  2. C实现一个状态机,我做毕业设计,实现自组织网络,三个节点-Finit state machine implemented in C code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.19kb
    • 提供者:york
  1. myfifo_syn

    0下载:
  2. fifo(1-6:1):using ip-code and rd wd interface-fifo:using ip-code and rd wd interface
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:6.4kb
    • 提供者:sunbaoyu
  1. myfifo_wave0

    0下载:
  2. fifo(1-6:1):using ip-code and rd wd interface-fifo:using ip-code and rd wd interface
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:68.28kb
    • 提供者:sunbaoyu
  1. myfifo_wave1

    0下载:
  2. fifo(1-6:1):using ip-code and rd wd interface-fifo:using ip-code and rd wd interface
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-29
    • 文件大小:63.47kb
    • 提供者:sunbaoyu
  1. fifo-interface

    0下载:
  2. fifo(1-6:1):using ip-code and rd wd interface-fifo:using ip-code and rd wd interface
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:1.43kb
    • 提供者:sunbaoyu
  1. FIFOinterface

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  2. fifo(8):using ip-code and rd wd interface-fifo:using ip-code and rd wd interface
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:143.41kb
    • 提供者:sunbaoyu
  1. quartus-reading-and-thinking

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  2. 本资料详细介绍了quartus11的使用方法和使用quartus11进行硬件详细开发流程。-quartus11:simple using the quartus11 sofeware .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:6.03kb
    • 提供者:sunbaoyu
  1. tlv5636

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  2. 音频DA tlv5636的接口程序 经过硬件测试的成功 学习状态机对器件编程的经典-DA tlv5636 audio through the interface program to test the success of hardware 。state machine to study the classic programming device
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:875byte
    • 提供者:cjy
  1. alu

    0下载:
  2. verilog code for alu in RISC processor
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1.12kb
    • 提供者:John jose
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