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  1. VHDL

    0下载:
  2. 基于EMP 7128的数字式相位测量仪相位测量仪
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:9.2kb
    • 提供者:YAGIC
  1. miniUART

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  2. 自适应波特率的通用异步串行接口电路(UART)的VHDL源码,在ALTERA上运行成功-Adaptive baud rate of the universal asynchronous serial interface circuit (UART) the VHDL source code, to run successfully in ALTERA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:9.2kb
    • 提供者:甘甜
  1. JK-flipflop_vhdl

    0下载:
  2. FOR LEARNING PURPOSE... VHDL CODE OF JK FLIPFLOP
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-28
    • 文件大小:9.21kb
    • 提供者:jigs
  1. 16qam vhdl

    0下载:
  2. 实现16QAM系统调制仿真,附件里面WORD文档是整合的程序,其他的是源文件
  3. 所属分类:VHDL编程

    • 发布日期:2010-10-16
    • 文件大小:9.21kb
    • 提供者:yhyiciyuan
  1. mnxhjc

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  2. 本实验用DA转换+比较器的方法对外界模拟信号进行检测,同时这种联合装置加上CPLD可以代替低频AD转换器的功能。-this experiment + DA conversion method of comparison to the outside world analog signal detection, while such joint CPLD devices can be replaced with low-frequency AD converter functions.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:9.21kb
    • 提供者:cheng
  1. lin_io_module

    0下载:
  2. this is very good sample.enjy it!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:9.21kb
    • 提供者:mora
  1. src

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  2. 通用异步串口的FPGA程序,用于实现与PC机通信。-The FPGA code of UART is used to achieve communication with PC.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:9.21kb
    • 提供者:zhj
  1. latches-

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  2. 锁存器,FPGA实验alter DE2开发板自带光盘的案例教程编程解析-Latch, FPGA experimental alter the DE2 development board comes with the CD case tutorial programming resolution
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:9.22kb
    • 提供者:冷静
  1. xapp693

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  2. 通过CPLD配置xilinx FPGA及程序版本管理的参考设计。-Reference design of XAPP693.
  3. 所属分类:VHDL编程

    • 发布日期:2017-04-16
    • 文件大小:9.22kb
    • 提供者:daneil
  1. sram_512x16bit

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  2. SRAM的控制器,与sopc集成,可直接使用,方便稳定高速,简单修改可适应于其他容量-SRAM Controller in SOPC
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-08-05
    • 文件大小:9.23kb
    • 提供者:冉学均
  1. semafor

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  2. This the code for 2 traffic lights. S1 is a senzor that tells when there are cars waiting and S2 says if people are waiting to cross.-This is the code for 2 traffic lights. S1 is a senzor that tells when there are cars waiting and S2 says if people a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:9.24kb
    • 提供者:iordan12345
  1. LCD

    0下载:
  2. VHDL语言的LCD显示程序,里面总共有两个程序,仅供参考-The VHDL language LCD display program,There are two procedures, for reference only
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:9.24kb
    • 提供者:wll
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